Changes neccesary to support full system coherence on the first level of caches with...
authorRon Dreslinski <rdreslin@umich.edu>
Mon, 17 Jan 2005 19:57:26 +0000 (14:57 -0500)
committerRon Dreslinski <rdreslin@umich.edu>
Mon, 17 Jan 2005 19:57:26 +0000 (14:57 -0500)
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Changes neccesary to support full system coherence on the first level of caches with a event based bus
-Change how the blocking is implemented
-Update coherence policy state table to include sotware prefetches and DMA requests

--HG--
extra : convert_revision : 80f37dc1c7221b684888e859b534d008c578669c