Update README master
authorAndrew Waterman <andrew@sifive.com>
Thu, 13 Sep 2018 06:56:49 +0000 (23:56 -0700)
committerAndrew Waterman <andrew@sifive.com>
Thu, 13 Sep 2018 06:56:49 +0000 (23:56 -0700)
README.md

index 60c09223af023cae325732575a1379dc54a04d03..018c7d3eadfe823050eb18862d14c6fa5aa0b9fb 100644 (file)
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-RISC-V ISA Simulator
-======================
-
-Author  : Andrew Waterman, Yunsup Lee
-
-Date    : June 19, 2011
-
-Version : (under version control)
+Spike RISC-V ISA Simulator
+============================
 
 About
 -------------
 
 
 About
 -------------
 
-The RISC-V ISA Simulator implements a functional model of one or more
+Spike, the RISC-V ISA Simulator, implements a functional model of one or more
 RISC-V processors.
 
 RISC-V processors.
 
+Spike is named after the golden spike used to celebrate the completion of the
+US transcontinental railway.
+
 Build Steps
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 Build Steps
 ---------------