+2019-08-05 Barnaby Wilks <barnaby.wilks@arm.com>
+
+ * config/tc-arm.c (do_mve_vqdmlah): Use N_S_32 macro.
+ (do_neon_qrdmlah): Use N_S_32 macro.
+ * testsuite/gas/arm/mve-vqdmlah-bad.d: New test.
+ * testsuite/gas/arm/mve-vqdmlah-bad.l: New test.
+ * testsuite/gas/arm/mve-vqdmlah-bad.s: New test.
+ * testsuite/gas/arm/mve-vqdmlah.d: Remove unsigned instruction tests.
+ * testsuite/gas/arm/mve-vqdmlah.s: Remove unsigned instruction tests.
+ * testsuite/gas/arm/mve-vqdmlash-bad.d: New test.
+ * testsuite/gas/arm/mve-vqdmlash-bad.l: New test.
+ * testsuite/gas/arm/mve-vqdmlash-bad.s: New test.
+ * testsuite/gas/arm/mve-vqdmlash.d: Remove unsigned instruction tests.
+ * testsuite/gas/arm/mve-vqdmlash.s: Remove unsigned instruction tests.
+
2019-07-30 Mel Chen <mel.chen@sifive.com>
* testsuite/gas/riscv/alias-csr.s: Add testcase for CSR-access
{
enum neon_shape rs = neon_select_shape (NS_QQR, NS_NULL);
struct neon_type_el et
- = neon_check_type (3, rs, N_EQK, N_EQK, N_SU_MVE | N_KEY);
+ = neon_check_type (3, rs, N_EQK, N_EQK, N_S_32 | N_KEY);
if (inst.cond > COND_ALWAYS)
inst.pred_insn_type = INSIDE_VPT_INSN;
{
enum neon_shape rs = neon_select_shape (NS_QQR, NS_NULL);
struct neon_type_el et
- = neon_check_type (3, rs, N_EQK, N_EQK, N_SU_MVE | N_KEY);
+ = neon_check_type (3, rs, N_EQK, N_EQK, N_S_32 | N_KEY);
NEON_ENCODE (INTEGER, inst);
mve_encode_qqr (et.size, et.type == NT_unsigned, 0);
--- /dev/null
+#name: bad MVE VQDMLAH and VQRDMLAH instructions
+#as: -march=armv8.1-m.main+mve.fp
+#error_output: mve-vqdmlah-bad.l
--- /dev/null
+[^:]*: Assembler messages:
+[^:]*:4: Error: bad type in SIMD instruction -- `vqdmlah.u8 q1,q2,r0'
+[^:]*:4: Error: bad type in SIMD instruction -- `vqrdmlah.u8 q3,q4,r5'
+[^:]*:4: Error: bad type in SIMD instruction -- `vqdmlah.u16 q1,q2,r0'
+[^:]*:4: Error: bad type in SIMD instruction -- `vqrdmlah.u16 q3,q4,r5'
+[^:]*:4: Error: bad type in SIMD instruction -- `vqdmlah.u32 q1,q2,r0'
+[^:]*:4: Error: bad type in SIMD instruction -- `vqrdmlah.u32 q3,q4,r5'
--- /dev/null
+.irp data, u8, u16, u32
+vqdmlah.\data q1, q2, r0
+vqrdmlah.\data q3, q4, r5
+.endr
[^>]*> ee0e ee4c vqrdmlah.s8 q7, q7, ip
[^>]*> ee0e ee6e vqdmlah.s8 q7, q7, lr
[^>]*> ee0e ee4e vqrdmlah.s8 q7, q7, lr
-[^>]*> fe00 0e60 vqdmlah.u8 q0, q0, r0
-[^>]*> fe00 0e40 vqrdmlah.u8 q0, q0, r0
-[^>]*> fe00 0e61 vqdmlah.u8 q0, q0, r1
-[^>]*> fe00 0e41 vqrdmlah.u8 q0, q0, r1
-[^>]*> fe00 0e62 vqdmlah.u8 q0, q0, r2
-[^>]*> fe00 0e42 vqrdmlah.u8 q0, q0, r2
-[^>]*> fe00 0e64 vqdmlah.u8 q0, q0, r4
-[^>]*> fe00 0e44 vqrdmlah.u8 q0, q0, r4
-[^>]*> fe00 0e67 vqdmlah.u8 q0, q0, r7
-[^>]*> fe00 0e47 vqrdmlah.u8 q0, q0, r7
-[^>]*> fe00 0e68 vqdmlah.u8 q0, q0, r8
-[^>]*> fe00 0e48 vqrdmlah.u8 q0, q0, r8
-[^>]*> fe00 0e6a vqdmlah.u8 q0, q0, sl
-[^>]*> fe00 0e4a vqrdmlah.u8 q0, q0, sl
-[^>]*> fe00 0e6c vqdmlah.u8 q0, q0, ip
-[^>]*> fe00 0e4c vqrdmlah.u8 q0, q0, ip
-[^>]*> fe00 0e6e vqdmlah.u8 q0, q0, lr
-[^>]*> fe00 0e4e vqrdmlah.u8 q0, q0, lr
-[^>]*> fe02 0e60 vqdmlah.u8 q0, q1, r0
-[^>]*> fe02 0e40 vqrdmlah.u8 q0, q1, r0
-[^>]*> fe02 0e61 vqdmlah.u8 q0, q1, r1
-[^>]*> fe02 0e41 vqrdmlah.u8 q0, q1, r1
-[^>]*> fe02 0e62 vqdmlah.u8 q0, q1, r2
-[^>]*> fe02 0e42 vqrdmlah.u8 q0, q1, r2
-[^>]*> fe02 0e64 vqdmlah.u8 q0, q1, r4
-[^>]*> fe02 0e44 vqrdmlah.u8 q0, q1, r4
-[^>]*> fe02 0e67 vqdmlah.u8 q0, q1, r7
-[^>]*> fe02 0e47 vqrdmlah.u8 q0, q1, r7
-[^>]*> fe02 0e68 vqdmlah.u8 q0, q1, r8
-[^>]*> fe02 0e48 vqrdmlah.u8 q0, q1, r8
-[^>]*> fe02 0e6a vqdmlah.u8 q0, q1, sl
-[^>]*> fe02 0e4a vqrdmlah.u8 q0, q1, sl
-[^>]*> fe02 0e6c vqdmlah.u8 q0, q1, ip
-[^>]*> fe02 0e4c vqrdmlah.u8 q0, q1, ip
-[^>]*> fe02 0e6e vqdmlah.u8 q0, q1, lr
-[^>]*> fe02 0e4e vqrdmlah.u8 q0, q1, lr
-[^>]*> fe04 0e60 vqdmlah.u8 q0, q2, r0
-[^>]*> fe04 0e40 vqrdmlah.u8 q0, q2, r0
-[^>]*> fe04 0e61 vqdmlah.u8 q0, q2, r1
-[^>]*> fe04 0e41 vqrdmlah.u8 q0, q2, r1
-[^>]*> fe04 0e62 vqdmlah.u8 q0, q2, r2
-[^>]*> fe04 0e42 vqrdmlah.u8 q0, q2, r2
-[^>]*> fe04 0e64 vqdmlah.u8 q0, q2, r4
-[^>]*> fe04 0e44 vqrdmlah.u8 q0, q2, r4
-[^>]*> fe04 0e67 vqdmlah.u8 q0, q2, r7
-[^>]*> fe04 0e47 vqrdmlah.u8 q0, q2, r7
-[^>]*> fe04 0e68 vqdmlah.u8 q0, q2, r8
-[^>]*> fe04 0e48 vqrdmlah.u8 q0, q2, r8
-[^>]*> fe04 0e6a vqdmlah.u8 q0, q2, sl
-[^>]*> fe04 0e4a vqrdmlah.u8 q0, q2, sl
-[^>]*> fe04 0e6c vqdmlah.u8 q0, q2, ip
-[^>]*> fe04 0e4c vqrdmlah.u8 q0, q2, ip
-[^>]*> fe04 0e6e vqdmlah.u8 q0, q2, lr
-[^>]*> fe04 0e4e vqrdmlah.u8 q0, q2, lr
-[^>]*> fe08 0e60 vqdmlah.u8 q0, q4, r0
-[^>]*> fe08 0e40 vqrdmlah.u8 q0, q4, r0
-[^>]*> fe08 0e61 vqdmlah.u8 q0, q4, r1
-[^>]*> fe08 0e41 vqrdmlah.u8 q0, q4, r1
-[^>]*> fe08 0e62 vqdmlah.u8 q0, q4, r2
-[^>]*> fe08 0e42 vqrdmlah.u8 q0, q4, r2
-[^>]*> fe08 0e64 vqdmlah.u8 q0, q4, r4
-[^>]*> fe08 0e44 vqrdmlah.u8 q0, q4, r4
-[^>]*> fe08 0e67 vqdmlah.u8 q0, q4, r7
-[^>]*> fe08 0e47 vqrdmlah.u8 q0, q4, r7
-[^>]*> fe08 0e68 vqdmlah.u8 q0, q4, r8
-[^>]*> fe08 0e48 vqrdmlah.u8 q0, q4, r8
-[^>]*> fe08 0e6a vqdmlah.u8 q0, q4, sl
-[^>]*> fe08 0e4a vqrdmlah.u8 q0, q4, sl
-[^>]*> fe08 0e6c vqdmlah.u8 q0, q4, ip
-[^>]*> fe08 0e4c vqrdmlah.u8 q0, q4, ip
-[^>]*> fe08 0e6e vqdmlah.u8 q0, q4, lr
-[^>]*> fe08 0e4e vqrdmlah.u8 q0, q4, lr
-[^>]*> fe0e 0e60 vqdmlah.u8 q0, q7, r0
-[^>]*> fe0e 0e40 vqrdmlah.u8 q0, q7, r0
-[^>]*> fe0e 0e61 vqdmlah.u8 q0, q7, r1
-[^>]*> fe0e 0e41 vqrdmlah.u8 q0, q7, r1
-[^>]*> fe0e 0e62 vqdmlah.u8 q0, q7, r2
-[^>]*> fe0e 0e42 vqrdmlah.u8 q0, q7, r2
-[^>]*> fe0e 0e64 vqdmlah.u8 q0, q7, r4
-[^>]*> fe0e 0e44 vqrdmlah.u8 q0, q7, r4
-[^>]*> fe0e 0e67 vqdmlah.u8 q0, q7, r7
-[^>]*> fe0e 0e47 vqrdmlah.u8 q0, q7, r7
-[^>]*> fe0e 0e68 vqdmlah.u8 q0, q7, r8
-[^>]*> fe0e 0e48 vqrdmlah.u8 q0, q7, r8
-[^>]*> fe0e 0e6a vqdmlah.u8 q0, q7, sl
-[^>]*> fe0e 0e4a vqrdmlah.u8 q0, q7, sl
-[^>]*> fe0e 0e6c vqdmlah.u8 q0, q7, ip
-[^>]*> fe0e 0e4c vqrdmlah.u8 q0, q7, ip
-[^>]*> fe0e 0e6e vqdmlah.u8 q0, q7, lr
-[^>]*> fe0e 0e4e vqrdmlah.u8 q0, q7, lr
-[^>]*> fe00 2e60 vqdmlah.u8 q1, q0, r0
-[^>]*> fe00 2e40 vqrdmlah.u8 q1, q0, r0
-[^>]*> fe00 2e61 vqdmlah.u8 q1, q0, r1
-[^>]*> fe00 2e41 vqrdmlah.u8 q1, q0, r1
-[^>]*> fe00 2e62 vqdmlah.u8 q1, q0, r2
-[^>]*> fe00 2e42 vqrdmlah.u8 q1, q0, r2
-[^>]*> fe00 2e64 vqdmlah.u8 q1, q0, r4
-[^>]*> fe00 2e44 vqrdmlah.u8 q1, q0, r4
-[^>]*> fe00 2e67 vqdmlah.u8 q1, q0, r7
-[^>]*> fe00 2e47 vqrdmlah.u8 q1, q0, r7
-[^>]*> fe00 2e68 vqdmlah.u8 q1, q0, r8
-[^>]*> fe00 2e48 vqrdmlah.u8 q1, q0, r8
-[^>]*> fe00 2e6a vqdmlah.u8 q1, q0, sl
-[^>]*> fe00 2e4a vqrdmlah.u8 q1, q0, sl
-[^>]*> fe00 2e6c vqdmlah.u8 q1, q0, ip
-[^>]*> fe00 2e4c vqrdmlah.u8 q1, q0, ip
-[^>]*> fe00 2e6e vqdmlah.u8 q1, q0, lr
-[^>]*> fe00 2e4e vqrdmlah.u8 q1, q0, lr
-[^>]*> fe02 2e60 vqdmlah.u8 q1, q1, r0
-[^>]*> fe02 2e40 vqrdmlah.u8 q1, q1, r0
-[^>]*> fe02 2e61 vqdmlah.u8 q1, q1, r1
-[^>]*> fe02 2e41 vqrdmlah.u8 q1, q1, r1
-[^>]*> fe02 2e62 vqdmlah.u8 q1, q1, r2
-[^>]*> fe02 2e42 vqrdmlah.u8 q1, q1, r2
-[^>]*> fe02 2e64 vqdmlah.u8 q1, q1, r4
-[^>]*> fe02 2e44 vqrdmlah.u8 q1, q1, r4
-[^>]*> fe02 2e67 vqdmlah.u8 q1, q1, r7
-[^>]*> fe02 2e47 vqrdmlah.u8 q1, q1, r7
-[^>]*> fe02 2e68 vqdmlah.u8 q1, q1, r8
-[^>]*> fe02 2e48 vqrdmlah.u8 q1, q1, r8
-[^>]*> fe02 2e6a vqdmlah.u8 q1, q1, sl
-[^>]*> fe02 2e4a vqrdmlah.u8 q1, q1, sl
-[^>]*> fe02 2e6c vqdmlah.u8 q1, q1, ip
-[^>]*> fe02 2e4c vqrdmlah.u8 q1, q1, ip
-[^>]*> fe02 2e6e vqdmlah.u8 q1, q1, lr
-[^>]*> fe02 2e4e vqrdmlah.u8 q1, q1, lr
-[^>]*> fe04 2e60 vqdmlah.u8 q1, q2, r0
-[^>]*> fe04 2e40 vqrdmlah.u8 q1, q2, r0
-[^>]*> fe04 2e61 vqdmlah.u8 q1, q2, r1
-[^>]*> fe04 2e41 vqrdmlah.u8 q1, q2, r1
-[^>]*> fe04 2e62 vqdmlah.u8 q1, q2, r2
-[^>]*> fe04 2e42 vqrdmlah.u8 q1, q2, r2
-[^>]*> fe04 2e64 vqdmlah.u8 q1, q2, r4
-[^>]*> fe04 2e44 vqrdmlah.u8 q1, q2, r4
-[^>]*> fe04 2e67 vqdmlah.u8 q1, q2, r7
-[^>]*> fe04 2e47 vqrdmlah.u8 q1, q2, r7
-[^>]*> fe04 2e68 vqdmlah.u8 q1, q2, r8
-[^>]*> fe04 2e48 vqrdmlah.u8 q1, q2, r8
-[^>]*> fe04 2e6a vqdmlah.u8 q1, q2, sl
-[^>]*> fe04 2e4a vqrdmlah.u8 q1, q2, sl
-[^>]*> fe04 2e6c vqdmlah.u8 q1, q2, ip
-[^>]*> fe04 2e4c vqrdmlah.u8 q1, q2, ip
-[^>]*> fe04 2e6e vqdmlah.u8 q1, q2, lr
-[^>]*> fe04 2e4e vqrdmlah.u8 q1, q2, lr
-[^>]*> fe08 2e60 vqdmlah.u8 q1, q4, r0
-[^>]*> fe08 2e40 vqrdmlah.u8 q1, q4, r0
-[^>]*> fe08 2e61 vqdmlah.u8 q1, q4, r1
-[^>]*> fe08 2e41 vqrdmlah.u8 q1, q4, r1
-[^>]*> fe08 2e62 vqdmlah.u8 q1, q4, r2
-[^>]*> fe08 2e42 vqrdmlah.u8 q1, q4, r2
-[^>]*> fe08 2e64 vqdmlah.u8 q1, q4, r4
-[^>]*> fe08 2e44 vqrdmlah.u8 q1, q4, r4
-[^>]*> fe08 2e67 vqdmlah.u8 q1, q4, r7
-[^>]*> fe08 2e47 vqrdmlah.u8 q1, q4, r7
-[^>]*> fe08 2e68 vqdmlah.u8 q1, q4, r8
-[^>]*> fe08 2e48 vqrdmlah.u8 q1, q4, r8
-[^>]*> fe08 2e6a vqdmlah.u8 q1, q4, sl
-[^>]*> fe08 2e4a vqrdmlah.u8 q1, q4, sl
-[^>]*> fe08 2e6c vqdmlah.u8 q1, q4, ip
-[^>]*> fe08 2e4c vqrdmlah.u8 q1, q4, ip
-[^>]*> fe08 2e6e vqdmlah.u8 q1, q4, lr
-[^>]*> fe08 2e4e vqrdmlah.u8 q1, q4, lr
-[^>]*> fe0e 2e60 vqdmlah.u8 q1, q7, r0
-[^>]*> fe0e 2e40 vqrdmlah.u8 q1, q7, r0
-[^>]*> fe0e 2e61 vqdmlah.u8 q1, q7, r1
-[^>]*> fe0e 2e41 vqrdmlah.u8 q1, q7, r1
-[^>]*> fe0e 2e62 vqdmlah.u8 q1, q7, r2
-[^>]*> fe0e 2e42 vqrdmlah.u8 q1, q7, r2
-[^>]*> fe0e 2e64 vqdmlah.u8 q1, q7, r4
-[^>]*> fe0e 2e44 vqrdmlah.u8 q1, q7, r4
-[^>]*> fe0e 2e67 vqdmlah.u8 q1, q7, r7
-[^>]*> fe0e 2e47 vqrdmlah.u8 q1, q7, r7
-[^>]*> fe0e 2e68 vqdmlah.u8 q1, q7, r8
-[^>]*> fe0e 2e48 vqrdmlah.u8 q1, q7, r8
-[^>]*> fe0e 2e6a vqdmlah.u8 q1, q7, sl
-[^>]*> fe0e 2e4a vqrdmlah.u8 q1, q7, sl
-[^>]*> fe0e 2e6c vqdmlah.u8 q1, q7, ip
-[^>]*> fe0e 2e4c vqrdmlah.u8 q1, q7, ip
-[^>]*> fe0e 2e6e vqdmlah.u8 q1, q7, lr
-[^>]*> fe0e 2e4e vqrdmlah.u8 q1, q7, lr
-[^>]*> fe00 4e60 vqdmlah.u8 q2, q0, r0
-[^>]*> fe00 4e40 vqrdmlah.u8 q2, q0, r0
-[^>]*> fe00 4e61 vqdmlah.u8 q2, q0, r1
-[^>]*> fe00 4e41 vqrdmlah.u8 q2, q0, r1
-[^>]*> fe00 4e62 vqdmlah.u8 q2, q0, r2
-[^>]*> fe00 4e42 vqrdmlah.u8 q2, q0, r2
-[^>]*> fe00 4e64 vqdmlah.u8 q2, q0, r4
-[^>]*> fe00 4e44 vqrdmlah.u8 q2, q0, r4
-[^>]*> fe00 4e67 vqdmlah.u8 q2, q0, r7
-[^>]*> fe00 4e47 vqrdmlah.u8 q2, q0, r7
-[^>]*> fe00 4e68 vqdmlah.u8 q2, q0, r8
-[^>]*> fe00 4e48 vqrdmlah.u8 q2, q0, r8
-[^>]*> fe00 4e6a vqdmlah.u8 q2, q0, sl
-[^>]*> fe00 4e4a vqrdmlah.u8 q2, q0, sl
-[^>]*> fe00 4e6c vqdmlah.u8 q2, q0, ip
-[^>]*> fe00 4e4c vqrdmlah.u8 q2, q0, ip
-[^>]*> fe00 4e6e vqdmlah.u8 q2, q0, lr
-[^>]*> fe00 4e4e vqrdmlah.u8 q2, q0, lr
-[^>]*> fe02 4e60 vqdmlah.u8 q2, q1, r0
-[^>]*> fe02 4e40 vqrdmlah.u8 q2, q1, r0
-[^>]*> fe02 4e61 vqdmlah.u8 q2, q1, r1
-[^>]*> fe02 4e41 vqrdmlah.u8 q2, q1, r1
-[^>]*> fe02 4e62 vqdmlah.u8 q2, q1, r2
-[^>]*> fe02 4e42 vqrdmlah.u8 q2, q1, r2
-[^>]*> fe02 4e64 vqdmlah.u8 q2, q1, r4
-[^>]*> fe02 4e44 vqrdmlah.u8 q2, q1, r4
-[^>]*> fe02 4e67 vqdmlah.u8 q2, q1, r7
-[^>]*> fe02 4e47 vqrdmlah.u8 q2, q1, r7
-[^>]*> fe02 4e68 vqdmlah.u8 q2, q1, r8
-[^>]*> fe02 4e48 vqrdmlah.u8 q2, q1, r8
-[^>]*> fe02 4e6a vqdmlah.u8 q2, q1, sl
-[^>]*> fe02 4e4a vqrdmlah.u8 q2, q1, sl
-[^>]*> fe02 4e6c vqdmlah.u8 q2, q1, ip
-[^>]*> fe02 4e4c vqrdmlah.u8 q2, q1, ip
-[^>]*> fe02 4e6e vqdmlah.u8 q2, q1, lr
-[^>]*> fe02 4e4e vqrdmlah.u8 q2, q1, lr
-[^>]*> fe04 4e60 vqdmlah.u8 q2, q2, r0
-[^>]*> fe04 4e40 vqrdmlah.u8 q2, q2, r0
-[^>]*> fe04 4e61 vqdmlah.u8 q2, q2, r1
-[^>]*> fe04 4e41 vqrdmlah.u8 q2, q2, r1
-[^>]*> fe04 4e62 vqdmlah.u8 q2, q2, r2
-[^>]*> fe04 4e42 vqrdmlah.u8 q2, q2, r2
-[^>]*> fe04 4e64 vqdmlah.u8 q2, q2, r4
-[^>]*> fe04 4e44 vqrdmlah.u8 q2, q2, r4
-[^>]*> fe04 4e67 vqdmlah.u8 q2, q2, r7
-[^>]*> fe04 4e47 vqrdmlah.u8 q2, q2, r7
-[^>]*> fe04 4e68 vqdmlah.u8 q2, q2, r8
-[^>]*> fe04 4e48 vqrdmlah.u8 q2, q2, r8
-[^>]*> fe04 4e6a vqdmlah.u8 q2, q2, sl
-[^>]*> fe04 4e4a vqrdmlah.u8 q2, q2, sl
-[^>]*> fe04 4e6c vqdmlah.u8 q2, q2, ip
-[^>]*> fe04 4e4c vqrdmlah.u8 q2, q2, ip
-[^>]*> fe04 4e6e vqdmlah.u8 q2, q2, lr
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-[^>]*> fe22 ee48 vqrdmlah.u32 q7, q1, r8
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[^>]*> fe71 ef4d vpstete
[^>]*> ee02 0e62 vqdmlaht.s8 q0, q1, r2
-[^>]*> fe1e ee6e vqdmlahe.u16 q7, q7, lr
+[^>]*> ee1e ee6e vqdmlahe.s16 q7, q7, lr
[^>]*> ee20 0e40 vqrdmlaht.s32 q0, q0, r0
-[^>]*> fe0e ee4e vqrdmlahe.u8 q7, q7, lr
+[^>]*> ee0e ee4e vqrdmlahe.s8 q7, q7, lr
.syntax unified
.thumb
-.irp data, s8, u8, s16, u16, s32, u32
+.irp data, s8, s16, s32
.irp op1, q0, q1, q2, q4, q7
.irp op2, q0, q1, q2, q4, q7
.irp op3, r0, r1, r2, r4, r7, r8, r10, r12, r14
vpstete
vqdmlaht.s8 q0, q1, r2
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+vqdmlahe.s16 q7, q7, r14
vqrdmlaht.s32 q0, q0, r0
-vqrdmlahe.u8 q7, q7, r14
+vqrdmlahe.s8 q7, q7, r14
--- /dev/null
+#name: bad VQDMLASH and VQRDMLASH instructions
+#as: -march=armv8.1-m.main+mve.fp
+#error_output: mve-vqdmlash-bad.l
--- /dev/null
+[^:]*: Assembler messages:
+[^:]*:4: Error: bad type in SIMD instruction -- `vqdmlash.u8 q0,q2,r0'
+[^:]*:4: Error: bad type in SIMD instruction -- `vqrdmlash.u8 q1,q3,r1'
+[^:]*:4: Error: bad type in SIMD instruction -- `vqdmlash.u16 q0,q2,r0'
+[^:]*:4: Error: bad type in SIMD instruction -- `vqrdmlash.u16 q1,q3,r1'
+[^:]*:4: Error: bad type in SIMD instruction -- `vqdmlash.u32 q0,q2,r0'
+[^:]*:4: Error: bad type in SIMD instruction -- `vqrdmlash.u32 q1,q3,r1'
--- /dev/null
+.irp data, u8, u16, u32
+vqdmlash.\data q0, q2, r0
+vqrdmlash.\data q1, q3, r1
+.endr
[^>]*> ee0e fe4c vqrdmlash.s8 q7, q7, ip
[^>]*> ee0e fe6e vqdmlash.s8 q7, q7, lr
[^>]*> ee0e fe4e vqrdmlash.s8 q7, q7, lr
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-[^>]*> fe04 1e4a vqrdmlash.u8 q0, q2, sl
-[^>]*> fe04 1e6c vqdmlash.u8 q0, q2, ip
-[^>]*> fe04 1e4c vqrdmlash.u8 q0, q2, ip
-[^>]*> fe04 1e6e vqdmlash.u8 q0, q2, lr
-[^>]*> fe04 1e4e vqrdmlash.u8 q0, q2, lr
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-[^>]*> fe08 1e44 vqrdmlash.u8 q0, q4, r4
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-[^>]*> fe08 1e4a vqrdmlash.u8 q0, q4, sl
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-[^>]*> fe0e 1e42 vqrdmlash.u8 q0, q7, r2
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-[^>]*> fe0e 1e68 vqdmlash.u8 q0, q7, r8
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-[^>]*> fe0e 1e4a vqrdmlash.u8 q0, q7, sl
-[^>]*> fe0e 1e6c vqdmlash.u8 q0, q7, ip
-[^>]*> fe0e 1e4c vqrdmlash.u8 q0, q7, ip
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-[^>]*> fe08 3e68 vqdmlash.u8 q1, q4, r8
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+
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2019-07-30 Mel Chen <mel.chen@sifive.com>
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