Update CHANGELOG
authorMiodrag Milanovic <mmicko@gmail.com>
Wed, 2 Mar 2022 13:26:15 +0000 (14:26 +0100)
committerMiodrag Milanovic <mmicko@gmail.com>
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CHANGELOG

index dcb88d6fe7dfa11932531c209231044a5202178c..0b1bbc733b8e01fa09489c2a6d3f1c13d950a9f3 100644 (file)
--- a/CHANGELOG
+++ b/CHANGELOG
@@ -5,6 +5,11 @@ List of major changes and improvements between releases
 Yosys 0.14 .. Yosys 0.14-dev
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+ * Various
+    - clk2fflogic: nice names for autogenerated signals
+    - simulation include support for all flip-flop types.
+    - Added AIGER witness file co-simulation.
+
  * Verilog
     - Fixed evaluation of constant functions with variables or arguments with
       reversed dimensions
@@ -14,6 +19,13 @@ Yosys 0.14 .. Yosys 0.14-dev
 
  * SystemVerilog
     - Added support for accessing whole sub-structures in expressions
+ * New commands and options
+    - Added glift command, used to create gate-level information flow tracking
+      (GLIFT) models by the "constructive mapping" approach
+
+ * Verific support
+    - Ability to override default parser mode for verific -f command.
 
 Yosys 0.13 .. Yosys 0.14
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