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authorLuke Kenneth Casson Leighton <lkcl@lkcl.net>
Wed, 23 Jun 2021 13:48:31 +0000 (14:48 +0100)
committerLuke Kenneth Casson Leighton <lkcl@lkcl.net>
Wed, 23 Jun 2021 13:48:31 +0000 (14:48 +0100)
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index 4e457e72b0976ee2c5e001db1c7a39f69f92f603..ea2a4a8d635a0a4eb754b67ee7df436a4a45eb25 100644 (file)
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 <!-- SVP64 FP Instructions here described are based on -->
 <!--  PowerISA Version 3.0 B Book 1 -->
 
+<!-- FRS in each of these does not need to be explicitly declared -->
+<!-- FRS is automatically calculated by SVP64 to FRT+VL (default elwidth) -->
+<!-- (Vector FRS data sequentially starts immediately after FRT vectors) -->
+
 # Floating Add FFT/DCT [Single]
 
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