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authorLuke Kenneth Casson Leighton <lkcl@lkcl.net>
Tue, 25 Jun 2019 13:50:33 +0000 (14:50 +0100)
committerLuke Kenneth Casson Leighton <lkcl@lkcl.net>
Tue, 25 Jun 2019 13:50:33 +0000 (14:50 +0100)
simple_v_extension/specification.mdwn

index 5f3dd51cec05aa3ce36de655b21c73d9cca06bbc..df52287e713d4c34549ea6b07a396f3221c3bfe5 100644 (file)
@@ -512,7 +512,7 @@ be applied to integer registers; 0 indicates that it is relevant to
 floating-point registers.
 
 The 8 bit format is used for a much more compact expression. "isvec"
-is implicit and, similar to [[sv-prefix-proposal]], the target vector
+is implicit and, similar to [[sv_prefix_proposal]], the target vector
 is "regnum<<2", implicitly. Contrast this with the 16-bit format where
 the target vector is *explicitly* named in bits 8 to 14, and bit 15 may
 optionally set "scalar" mode.