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authorLuke Kenneth Casson Leighton <lkcl@lkcl.net>
Thu, 26 Apr 2018 07:25:15 +0000 (08:25 +0100)
committerLuke Kenneth Casson Leighton <lkcl@lkcl.net>
Thu, 26 Apr 2018 07:25:15 +0000 (08:25 +0100)
isa_conflict_resolution.mdwn

index e3a55be3e919f4998debe9470712ad4dbbe86e41..f7e06b30b8698d177e9231e0c000387cdf826cf3 100644 (file)
@@ -47,9 +47,10 @@ flaws going unpatched, with one of many immediate undesirable consequences
 being that product in extremely large volume gets discarded into landfill.
 
 All and any of the issues that were discussed, and all of those that
-were not, can be avoided by providing a forwards and backwards
-compatible transition path between the current and future *mandatory*
-parts of revisions of the RISC-V ISA Standard.
+were not, can be avoided by providing a hardware-level runtime-enabled
+forwards and backwards compatible transition path between *all* parts
+(mandatory or not) of current and future revisions of the RISC-V ISA
+Standard.
 
 The rest of the discussion - indicative as it was of the stark mutually
 exclusive gap being faced by the RISC-V ISA Standard given that it does