Clean up more memory leaks

--HG--
extra : convert_revision : 32d1b23200752fe5fcdcbafb586f50bbe6db3bf3

Merge zizzer:/bk/newmem
into  zazzer.eecs.umich.edu:/z/rdreslin/m5bk/head

--HG--
extra : convert_revision : 8651b2878853c5a6cb15f60ab92cf39d3bc30a07

Fix some of the memory leaks related to writebacks

src/cpu/memtest/memtest.cc:
    Add the [] to a delete to make it work correctly
src/mem/cache/cache_impl.hh:
    Fix one of the memory leaks

--HG--
extra : convert_revision : 64c7465c68a084efe38a62419205518b24d852a7

Get rid of those pesky valgrind warnings, Conditional jump or move depends on uninitialised value(s), in the stats package

--HG--
extra : convert_revision : d3a508fc98df4eb8160a211a306be6ab241a4ce8

Merge zizzer:/bk/newmem
into  zeep.pool:/z/saidi/work/m5.newmem

--HG--
extra : convert_revision : c6fbe09348b606b94bbb35f911dea94353f076f9

move hver code to ua2005.cc

src/arch/sparc/miscregfile.cc:
    this code should be in readFSreg
src/arch/sparc/ua2005.cc:
    move code froh miscregfile to ua2005.cc

--HG--
extra : convert_revision : fa450b04ad73ab6f6e25d66fa0368054263f09f9

Rework the way SCons recurses into subdirectories, making it
automatic.  The point is that now a subdirectory can be added
to the build process just by creating a SConscript file in it.
The process has two passes.  On the first pass, all subdirs
of the root of the tree are searched for SConsopts files.
These files contain any command line options that ought to be
added for a particular subdirectory.  On the second pass,
all subdirs of the src directory are searched for SConscript
files.  These files describe how to build any given subdirectory.
I have added a Source() function.  Any file (relative to the
directory in which the SConscript resides) passed to that
function is added to the build.  Clean up everything to take
advantage of Source().
function is added to the list of files to be built.

--HG--
extra : convert_revision : 103f6b490d2eb224436688c89cdc015211c4fd30

Merge zizzer.eecs.umich.edu:/bk/newmem
into  zower.eecs.umich.edu:/home/gblack/m5/newmem-statetrace-test

--HG--
extra : convert_revision : df36efd84d938e0e402648b85b3732ed786aaa29

If you can't get rid of the files you want to make sure are gone, assume they're already gone. Print a warning and move on.

--HG--
extra : convert_revision : 192740b1e1a7a30222c4e79c7e7a5770e682f014

Compilation fix

--HG--
extra : convert_revision : 8bfa5e9408d1ead0197aab5078c248876f90ea7a

I thought this code got deleted, but since it hasn't I've moved it to a place where it doesn't access freed memory.

--HG--
extra : convert_revision : 4d9023f6193004a3e9cbeebd3721bccb50b2aab0

Merge zizzer.eecs.umich.edu:/bk/newmem
into  zower.eecs.umich.edu:/home/gblack/m5/newmem-statetrace

--HG--
extra : convert_revision : 82a956ffc1bedb2c0d05c4ea3469f843f559a475

Use the TheISA namespace in case we're coming from a file that doesn't do that for us. This should be contained in the scope of the function and not leak elsewhere.

--HG--
extra : convert_revision : 0bb0e1457011505a99a871c443bc45f4365e9c7e

Split the syscall table, SPARC specific syscall implementations, and the 32 bit syscall table into it's own file. Corrected problems with the stat structure. These should be tested on 64 bit x86 and SPARC machines.

--HG--
extra : convert_revision : 5d9fe19e031b92e111069c6b89c3dbeb29975b8a

Merge zizzer:/bk/newmem
into  zeep.pool:/z/saidi/work/m5.newmem

--HG--
extra : convert_revision : 5804298706ac0f04fbe491326af71ce9ab74425a

implement ipi stufff for SPARC

src/arch/alpha/utility.hh:
src/arch/mips/utility.hh:
src/arch/sparc/utility.hh:
src/arch/x86/utility.hh:
    add hook for system to startup the cpu or not... in the case of FS sparc, only the first cpu would get spunup.. the rest sit in an idle state until they get an ipi
src/arch/sparc/isa/decoder.isa:
    handle writable bits of strandstatus register in miscregfile
src/arch/sparc/miscregfile.hh:
    some constants for the strand status register
src/arch/sparc/ua2005.cc:
    properly implement the strand status register
src/dev/sparc/iob.cc:
    implement ipi generation properly
src/sim/system.cc:
    call into the ISA to start the CPU (or not)

--HG--
extra : convert_revision : 0003b2032337d8a031a9fc044da726dbb2a9e36f

fix regress... SPARC_FS may not be in the builds so check for it

--HG--
extra : convert_revision : 16710e4c44bd34496ed31ae8e954544b06e92589

Two fixes:
1. Make sure connectMemPorts() only gets called when the CPU's peer gets changed.  This is done by making setPeer() virtual, and overriding it in the CPU's ports.  When it gets called on a CPU's port (dcache specifically), it calls the normal setPeer() function, and also connectMemPorts().
2. Consolidate redundant code that handles switching in a CPU.

src/cpu/base.cc:
    Move common code of switching over peers to base CPU.
src/cpu/base.hh:
    Move common code of switching over peers to BaseCPU.
src/cpu/o3/cpu.cc:
    Add in function that updates thread context's ports.
    Also use updated function to takeOverFrom() in BaseCPU.  This gets rid of some repeated code.
src/cpu/o3/cpu.hh:
    Include function to update thread context's memory ports.
src/cpu/o3/lsq.hh:
    Add function to dcache port that will update the memory ports upon getting a new peer.
    Also include a function that will tell the CPU to update those memory ports.
src/cpu/o3/lsq_impl.hh:
    Add function that will update the memory ports upon getting a new peer.
src/cpu/simple/atomic.cc:
src/cpu/simple/timing.cc:
    Add function that will update thread context's memory ports upon getting a new peer.
    Also use the new BaseCPU's take over from function.
src/cpu/simple/atomic.hh:
    Add in function (and dcache port) that will allow the dcache to update memory ports when it gets assigned a new peer.
src/cpu/simple/timing.hh:
    Add function that will update thread context's memory ports upon getting a new peer.
src/mem/port.hh:
    Make setPeer virtual so that other classes can override it.

--HG--
extra : convert_revision : 2050f1241dd2e83875d281cfc5ad5c6c8705fdaf

Panic if any CMT registers are accessed

src/arch/sparc/asi.cc:
src/arch/sparc/asi.hh:
    add CMT ASI registers
src/arch/sparc/tlb.cc:
    Panic if any of the CMT registers are being accessed

--HG--
extra : convert_revision : b9a94281e2074a576ac21d042b756950d509e758

stop m5 from leaking like a sieve
don't create a new physPort/virtPort every time activateContext() is called
add the ability to tell a memory object to delete it's reference to a port and a method to have a port call deletePortRefs()
on the port owner as well as delete it's peer
still need to stop calling connectMemoPorts() every time activateContext() is called or we'll overflow the bus id and panic

src/cpu/thread_state.cc:
    if we hav ea (phys|virt)Port don't create a new on, have it delete it's peer and then reuse it
src/mem/bus.cc:
src/mem/bus.hh:
    add ability to delete a port by usig a hash_map instead of an array to store port ids
    add a function to do deleting
src/mem/cache/cache.hh:
src/mem/cache/cache_impl.hh:
src/mem/mem_object.cc:
src/mem/mem_object.hh:
    adda function to delete port references from a memory object
src/mem/port.cc:
src/mem/port.hh:
    add a removeConn function that tell the owener to delete any references to the port and then deletes its peer

--HG--
extra : convert_revision : 272f0c8f80e1cf1ab1750d8be5a6c9aa110b06a4

Fixed an off-by-one error.

--HG--
extra : convert_revision : 498fef18cf339cabc2c00e4758bc8a0da857daca

Merge zizzer.eecs.umich.edu:/bk/newmem
into  zower.eecs.umich.edu:/home/gblack/m5/newmem-statetrace

--HG--
extra : convert_revision : becba8537b11ee4ef33bbf129bef2ca047403df5

Fix up the SPARC initial stack frame to match an actual 32 bit process.

--HG--
extra : convert_revision : 3995744c3bf955a370b18f6e88de1bfb82f79843

I missed a couple of WithEffects, this should do it

--HG--
extra : convert_revision : 19fce78a19b27b7ccb5e3653a64b46e6d5292915

fix compiling of FS after Gabe's last compile

--HG--
extra : convert_revision : a93fa5ad61aa2b8c18bf6c513b617f3425ffb220

Move the magic m5 PageTableFault into sim/faults.[hh,cc] since it's the same across all architectures.

--HG--
extra : convert_revision : 18d441eb7ac44df4df41771bfe3dec69f7fa70ec

Merge zizzer.eecs.umich.edu:/bk/newmem
into  ahchoo.blinky.homelinux.org:/home/gblack/m5/newmem

--HG--
extra : convert_revision : d764fe37c71269a04fcede6cbf30e24262447e89

Merge zizzer:/bk/newmem
into  zeep.pool:/tmp/newmem

--HG--
extra : convert_revision : f078a05729b5fe464a06a58bc4adcb374f560572

*MiscReg->*MiscRegNoEffect, *MiscRegWithEffect->*MiscReg

--HG--
extra : convert_revision : f799b65f1b2a6bf43605e6870b0f39b473dc492b

Add setData functions for the new Twin??_t types.

--HG--
extra : convert_revision : 6f4e08e76eb4a95eb08b11632f6e33ba458723b6

Add some constructors and an output operator to the Twin??_t types so that o3 SPARC will compile again.

--HG--
extra : convert_revision : af987aaeac87ee92a3b55cf0839d994cf7dea1af

Make byteswap work correctly on Twin??_t types.

--HG--
extra : convert_revision : a8a14078d62c24e480ffa69591edfc775d1d76cc

Merge zizzer:/bk/newmem
into  udhcp-macvpn-108.public.engin.umich.edu:/Users/ali/work/m5.newmem

--HG--
extra : convert_revision : c6b11f535cca7fd46f1a3cea3b5a966e8fa80347

If we're running the quick tests, remove the SPARC_FS build since we don't have any quick SPARC_FS tests at the moment

--HG--
extra : convert_revision : 4505f1600cae5d049560f3b397541e9a9dea0420

Cleanup

--HG--
extra : convert_revision : 31f1b0f760a6eb861652440f9d42aaf123ef4833

Merge zizzer.eecs.umich.edu:/bk/newmem
into  ahchoo.blinky.homelinux.org:/home/gblack/m5/newmem-x86

--HG--
extra : convert_revision : 0822fbcc377781b53d2de9ba40ab9d985ccbc039

Merge zizzer:/bk/newmem
into  zeep.pool:/z/saidi/work/m5.newmem

--HG--
extra : convert_revision : fa1e361fcae10fe7a91118007faeeabe3fecba2a

Add regression for SPARC "hard" instruction test. Only runs in simple-atomic right now since we don't have cache support for
the atomic instructions.

--HG--
extra : convert_revision : b7013e6963885dfe2b4630ac175e24ddad6d42a6

Python parameters types need analogous C++ types

--HG--
extra : convert_revision : d068dfec69b28d48fc299a4108e165decfaaace7

Move all of the parameters of the Root SimObject so they are
directly configured by python.  Move stuff from root.(cc|hh) to
core.(cc|hh) since it really belogs there now.
In the process, simplify how ticks are used in the python code.

--HG--
extra : convert_revision : cf82ee1ea20f9343924f30bacc2a38d4edee8df3

Get X86 to load an elf and start a process for it.

src/arch/x86/SConscript:
    Add in process source files.
src/arch/x86/isa_traits.hh:
    Replace magic constant numbers with the x86 register names.
src/arch/x86/miscregfile.cc:
    Make clear the miscreg file succeed. There aren't any misc regs, so clearing them is very easy.
src/arch/x86/process.hh:
    An X86 process class.
src/base/loader/elf_object.cc:
    Add in code to recognize x86 as an architecture.
src/base/traceflags.py:
    Add an x86 traceflag
src/sim/process.cc:
    Add in code to create an x86 process.
src/arch/x86/intregs.hh:
    A file which declares names for the integer register indices.
src/arch/x86/linux/linux.cc:
src/arch/x86/linux/linux.hh:
    A very simple translation of SPARC's linux.cc and linux.hh. It's probably not correct for x86, but it might not be correct for SPARC either.
src/arch/x86/linux/process.cc:
src/arch/x86/linux/process.hh:
    An x86 linux process. The syscall table is split out into it's own file.
src/arch/x86/linux/syscalls.cc:
    The x86 Linux syscall table and the uname function.
src/arch/x86/process.cc:
    The x86 process base class.
tests/test-progs/hello/bin/x86/linux/hello:
    An x86 hello world test binary.

--HG--
extra : convert_revision : f22919e010c07aeaf5757dca054d9877a537fd08

Python atexit handlers are called in reverse order.
Fix things so the stats dump happens last.

--HG--
extra : convert_revision : ea842dbcbb77dd1c715c4e5b57d2470e558c4265

Merge zizzer.eecs.umich.edu:/bk/newmem
into  zower.eecs.umich.edu:/home/gblack/m5/newmem-statetrace

--HG--
extra : convert_revision : 0959fb162253ff1eed8da0a990f58897322f0e1f

Fixing statetrace to work with 32 bit SPARC processes, as well as rewritting it's single stepping code.

--HG--
extra : convert_revision : 69b1668a850519ab98b02c525ec41ff727eb6036

Fill out a stub version of the vtophys header file.

--HG--
extra : convert_revision : 2c10a80a2f73207539e3f98b4a3b864d431f5035

Add in NumGDBRegs so the constructor to the base class can get all it's arguments.

--HG--
extra : convert_revision : fcec1ad134b53a419a952e556ed75cb1559a1127

Reorganize the floating point register file a little.

--HG--
extra : convert_revision : 643c147b77e931d49ac559681d4bbda737f6e1c7

Add some new source files.

--HG--
extra : convert_revision : 94f3f19eb91b7f54918640b7605008eb1fe75fc7

Stub decoder. This is probably even farther from finished than it looks...

--HG--
extra : convert_revision : a39a158fec4560f6eb7a6987592c473677c0b1ba

Add stub for x86 process creation

--HG--
extra : convert_revision : 3bdbc415a73c6bb4d723f68714a96c9f922ba5e6

Add x86 version of call to "decode"

--HG--
extra : convert_revision : bb799dcea58b51d6e1d3d744581ea48c5c1490fe

Add x86 to the Arch enum in the object file class.

--HG--
extra : convert_revision : bc8c5e78aac0e9033d6cbc756d8092369ac29072

Added missing include.

--HG--
extra : convert_revision : 9d00209e5c0ae8aa5ac37f9558627ee212a72c9b

Added LargestRead type for x86. I might have picked the wrong type.

--HG--
extra : convert_revision : 5570a595b9adbe9c35f9b4f8dd3b50533b5beb97

Stub implementation for x86.

--HG--
extra : convert_revision : 3eccbf699bb62139a06a9b249e56bd205bc316ed

Stub implementation for x86

--HG--
extra : convert_revision : dd6b4d14070a2e99c179c5f780c9935847da8eda

Added fault generation functions. I would still like to see these go away. The page table fault should be moved into sim/faults.hh because it's a "fake" m5 fault for se mode and shouldn't vary between architectures.

--HG--
extra : convert_revision : cafe25befd64f83a424c1a09f5e62a16df5408ad

Added an x86 dyninst

--HG--
extra : convert_revision : 2317e9bb0bcf8010ab5d02019f7a14eeb7b1459c

Added stub implementations or prototypes for all the functions in this file.

--HG--
extra : convert_revision : c0170eae8aeae130f81618ae49a60f879c2b523f

Added in a missing include.

--HG--
extra : convert_revision : 712480fef36bf7a34c2c0b8d19dd82689eb78a1d

Filled in a stub header file for setting the result of a syscall.

--HG--
extra : convert_revision : f0a2cdf7d669834b90444fc390b0aceede474737

Filled in a stub header file for a stacktrace object. I'm still not sure what this is for, and it probably doesn't work on anything but Alpha.

--HG--
extra : convert_revision : 9bc3833628d31799a7b578c450dac096a19aead3

Filled in a stub header file for remote gdb

--HG--
extra : convert_revision : 6289181697142f672548a4d4cf6e010171cb98e1

Correct a typo

--HG--
extra : convert_revision : 1e8ef87ddb28873045a08bd104afc8ce129c4299

Make the constructor (and all the other functions) public

--HG--
extra : convert_revision : 9d572651fc1722b15ae7dbc59c108d680c911f04

Various touch ups

--HG--
extra : convert_revision : 19ff30d969a46adbd256f674582a9e7d398b56ed

Added a missing include.

--HG--
extra : convert_revision : 15a1b49ff9e0a1a15bd2500bec9ec9bc95ee5898

Added a missing include.

--HG--
extra : convert_revision : 62583e5a5647913fb36e1aae265e8ac52a165829

Fix up the remote gdb include gaurds so it doesn't use the same symbol as Alpha does.

--HG--
extra : convert_revision : b75dbdd95ceb4ec71275588a5cf8e6b614cf4539

x86 register file includes.

--HG--
extra : convert_revision : c00a077dd7ae8f6b48c6939034be244bcf48d715

Include the x86 specific traits file.

--HG--
extra : convert_revision : bcf448aedd832022527cc972f7a1f0433987c564

Stub x86 Fault class which just panics.

--HG--
extra : convert_revision : abfcf4005ec636b1e6c085515b63c1d8e69e3370

A new file for x86 specific parameters. This could be implemented as a sim object?

--HG--
extra : convert_revision : 51757435bb0b20132f3ec5782db31382bb2cca18

Add in a declaration of class Checkpoint rather than expecting it to come from some other include.

--HG--
extra : convert_revision : adbd4899508e3d30959a504a48402f01d1187099

Merge zizzer.eecs.umich.edu:/bk/newmem
into  ahchoo.blinky.homelinux.org:/home/gblack/m5/newmem-x86

--HG--
extra : convert_revision : b585cea2221377eb2fceea8976c46a17c0034f51

Don't use the exact same name as a system header #define

--HG--
extra : convert_revision : 099e380395fc1fdaef993b019d3d4e596e8076c2

add a sparc fs regression

src/dev/sparc/iob.cc:
    don't warn on cpu restart/idle/halt stuff
tests/SConscript:
    add sparc target in test Sconscript
util/regress:
    Add SPARC_FS target in regress

--HG--
extra : convert_revision : 37fa21700ec4c350d87ca9723bc3359feb81c50a

Merge zizzer:/bk/newmem
into  zeep.pool:/z/saidi/work/m5.newmem

--HG--
extra : convert_revision : fd6464c9883783c7c2cbefba317f4a0f20dd24cb

Add Iob and remove the fake device

configs/common/FSConfig.py:
    add an attachOnChipIO to force people to think about where "onchip" i/o should be connected in their hierarchy

--HG--
extra : convert_revision : cf79a9a00760b7daf28063f407a04bd38b956843

Implement Niagara I/O interface and rework interrupts

configs/common/FSConfig.py:
    Use binaries we've compiled instead of the ones that come with Legion
src/arch/alpha/interrupts.hh:
    get rid of post(int int_type) and add a get_vec function that gets the interrupt vector for an interrupt number
src/arch/sparc/asi.cc:
    Add AsiIsInterrupt() to AsiIsMmu()
src/arch/sparc/faults.cc:
src/arch/sparc/faults.hh:
    Add InterruptVector type
src/arch/sparc/interrupts.hh:
    rework interrupts. They are no longer cleared when created... A I/O or ASI read/write needs to happen before they are cleared
src/arch/sparc/isa_traits.hh:
    Add the "interrupt" trap types to isa traits
src/arch/sparc/miscregfile.cc:
    add names for all the misc registers and possible post an interrupt when TL is changed.
src/arch/sparc/miscregfile.hh:
    Add a helper function to post an interrupt when pil < some set softint
src/arch/sparc/regfile.cc:
src/arch/sparc/regfile.hh:
    InterruptLevel shouldn't really live here, moved to interrupt.hh
src/arch/sparc/tlb.cc:
    Add interrupt ASIs to TLB
src/arch/sparc/ua2005.cc:
    Add checkSoftInt to check if a softint needs to be posted
    Check that a tickCompare isn't scheduled before scheduling one
    Post and clear interrupts on queue writes and what not
src/base/bitfield.hh:
    Add an helper function to return the msb that is set
src/cpu/base.cc:
src/cpu/base.hh:
    get rid of post_interrupt(type) since it's no longer needed.. Add a way to see what interrupts are pending
src/cpu/intr_control.cc:
src/cpu/intr_control.hh:
src/dev/alpha/tsunami_cchip.cc:
src/python/m5/objects/IntrControl.py:
    Make IntrControl have a system pointer rather than using a cpu pointer to get one
src/dev/sparc/SConscript:
    add iob to SConsscrip
tests/quick/10.linux-boot/ref/alpha/linux/tsunami-simple-atomic-dual/config.ini:
tests/quick/10.linux-boot/ref/alpha/linux/tsunami-simple-atomic-dual/config.out:
tests/quick/10.linux-boot/ref/alpha/linux/tsunami-simple-atomic/config.ini:
tests/quick/10.linux-boot/ref/alpha/linux/tsunami-simple-atomic/config.out:
tests/quick/10.linux-boot/ref/alpha/linux/tsunami-simple-timing-dual/config.ini:
tests/quick/10.linux-boot/ref/alpha/linux/tsunami-simple-timing-dual/config.out:
tests/quick/10.linux-boot/ref/alpha/linux/tsunami-simple-timing/config.ini:
tests/quick/10.linux-boot/ref/alpha/linux/tsunami-simple-timing/config.out:
tests/quick/80.netperf-stream/ref/alpha/linux/twosys-tsunami-simple-atomic/config.ini:
tests/quick/80.netperf-stream/ref/alpha/linux/twosys-tsunami-simple-atomic/config.out:
    update config.ini/out for intrcntrl not having a cpu pointer anymore

--HG--
extra : convert_revision : 38614f6b9ffc8f3c93949a94ff04b7d2987168dd

include signal.h

--HG--
extra : convert_revision : 9b5ad2704dfd63a1aa8ad0e4275fd0e3a7d32d6d

Filled in with basic x86 stuff. Some things are missing, wrong, or nonsensical for x86.

--HG--
extra : convert_revision : 2f7845db6d65b353985b474f7012cfbbaece6a39

Filled in with basic x86 information. Some things are missing, wrong, or non-sensical in x86.

--HG--
extra : convert_revision : bba78db3667e214c95bb127872d3fdf546619703

Add build hooks for x86.

--HG--
extra : convert_revision : 438eb74f14e6ea60bab5012110f3946c9213786e

Merge zizzer.eecs.umich.edu:/bk/newmem
into  iceaxe.int.chaotic.net:/Users/nate/work/m5/outgoing

--HG--
extra : convert_revision : b3d48721ead389fa807c0d5392039d4fc71a252e

Do the default argument stuff in python

--HG--
extra : convert_revision : 235f85e611a669401c6ddfbdf14244e80eb55888

Merge zizzer.eecs.umich.edu:/bk/newmem
into  ahchoo.blinky.homelinux.org:/home/gblack/m5/newmem-sparc32

--HG--
extra : convert_revision : bbd0def502e423e64e2c4f6415a4b043b60c7f90

Factor code out of main.cc and main.i into a bunch of files
so things are organized in a more sensible manner.  Take apart
finalInit and expose the individual functions which are now
called from python.  Make checkpointing a bit easier to use.

--HG--
extra : convert_revision : f470ddabbb47103e7b4734ef753c40089f2dcd9d

Implement the _llseek syscall. It's Linux only, so we'll actually use the lseek syscall.

--HG--
extra : convert_revision : cccfd5efddbba527c6fb4e07ad2ab235a2670918

Fix some issues with 32 bit processes.

--HG--
extra : convert_revision : b01b38bbf185f2279134db4976a9bdb3e381a670

Keep around which input set was used for a benchmark, and make vortex work with SPARC.

--HG--
extra : convert_revision : c891435a31e81fb8294484aedf340c0c96c8afa2

Merge zizzer.eecs.umich.edu:/bk/newmem
into  ahchoo.blinky.homelinux.org:/home/gblack/m5/newmem

--HG--
extra : convert_revision : dcb1fc0c6252fb96a956640c6d7995679da725e5

make ldtw(a) -- Twin 32 bit load work correctly -- by doing it the same way as the twin 64 bit loads

src/arch/isa_parser.py:
src/arch/sparc/isa/decoder.isa:
src/arch/sparc/isa/operands.isa:
src/base/bigint.hh:
src/cpu/simple/atomic.cc:
src/cpu/simple/timing.cc:
src/mem/packet_access.hh:
    make ldtw(a) Twin 32 bit load work correctly

--HG--
extra : convert_revision : 2646b269d58cc1774e896065875a56cf5e313b42

Forgot to commit this new file last earlier.

--HG--
extra : convert_revision : f2d80ae551b7e29426141d5c9fe355b43a0b9c7d

Make the m5 psuedo instructions use the BasicOperate format

--HG--
extra : convert_revision : f02da702ab9b99da124fac7e10a07386b04f3a0f

Merge zizzer.eecs.umich.edu:/bk/newmem
into  ahchoo.blinky.homelinux.org:/home/gblack/m5/newmem-sparc32

--HG--
extra : convert_revision : 88d1401f6e6b7c82344abef2c81b3c22bf6a0499

Make trap instructions always generate TrapInstruction Fault objects which call into the Process object to handle system calls. Refactored the Process objects, and move the handler code into it's own file, and add some syscalls which are used in a natively compiled hello world. Software traps with trap number 3 (not syscall number 3) are supposed to cause the register windows to be flushed but are ignored right now. Finally, made uname for SPARC report a 2.6.12 kernel which is what m22-018.pool happens to be running.

--HG--
extra : convert_revision : ea873f01c62234c0542f310cc143c6a7c76ade94

The "hostname" variable isn't used in the process classes. It should be removed from the other ones as well.

--HG--
extra : convert_revision : 0c07534de42d6c32ac26d9e43709111e3ab30d57

Fix issue with twolf where the presence or absence of two files, smred.sav or smred.sv2, would affect the outcome of the program. These names are based on the input file names which are in turn based on the input set selected. There may be more files like this generated for larger input sets, for example "mdred.sv3"

--HG--
extra : convert_revision : f4f1d3fd0fb28468b0ee507aaadf3c14aa9cf924

Merge zizzer.eecs.umich.edu:/bk/newmem
into  ahchoo.blinky.homelinux.org:/home/gblack/m5/newmem

--HG--
extra : convert_revision : 7e8c3572ede7d93910fc3e2a2e76d9a38b1f4243