platform/arty.py: Move Pmod definitions to 'connectors' section.

Merge pull request #59 from q3k/for-upstream/multiple-synthesis-directives

Allow for multiple synthesis directives in specials.

Allow for multiple synthesis directives in specials.

This is needed to specify timing constraints on some Lattice Diamond
library specials, like the EHXPLLL.

To keep backwards compatibility we allow the directive to still be a
single string. If it's not, we assume it's an iterable.

minor cleanup

Merge pull request #58 from q3k/for-upstream/picorv32-support

Implement IRQ for PicoRV32 on LiteX

Implement IRQ software support for RISC-V.

Well, at least PicoRV32-specific. Turns out there is no RISC-V
specification for simple microcontroller-like interrupts, so PicoRV32
implements its' own based on custom opcodes.

It's somewhat esoteric, and for example doesn't offer a global interrupt
enable/disable. For this we implement a thin wrapper in assembly and
then expose it via a few helpers in irq.h.

Import PicoRV32-specific instruction macros.

These come from the PicoRV32 repo and are released under the public
domain [1].

[1] - https://github.com/cliffordwolf/picorv32/blob/70f3c33ac8348a46eeca92796721dcf8cbcc326c/firmware/custom_ops.S

Write init files that respect CPU's endianness.

This is required for PicoRV32 support. We also drive-by enable
explicit specification of run= in Builder.build() by callers.

Set the MABI and MArch of the riscv target.

Again, this should be tunable, and synchronized with the core settings.

Enable hardware multiplier and divider in PicoRV32

This should become tunable later once we can configure whether we link
in the soft mul library or not.

Replace __riscv__ macros with __riscv.

The __riscv__ form is deprecated [1].

[1] - https://github.com/riscv/riscv-toolchain-conventions#cc-preprocessor-definitions

Export trap signal from PicoRV32.

This is useful for handling crashes from hardware.

Bump PicoRV32 version.

software/bios: add litex logo

Merge pull request #56 from cr1901/mimasv2

Add mimasv2 platform (pulled from litex-buildenv).

Add mimasv2 platform (pulled from litex-buildenv).

Merge pull request #53 from mithro/allow-forcing-colorama

Support forcing colorama colors on.

Support forcing colorama colors on.

This is needed if you want colors but are using pipes and similar.

Merge pull request #52 from ewen-naos-nz/tftp-alt-port

BIOS: Support alternate TFTP server port

BIOS: TFTP: try UDP/69 if specified port fails

BIOS: set TFTP_SERVER_PORT from enviroment

BIOS: allow BIOS to specify TFTP server port

Swaps hard coded PORT_OUT in tftp.c for parameter on the tftp_get()
and tftp_put() functions.  Allow TFTP_SERVER_PORT used by BIOS to be
set at compile time from compiler defines.

Merge pull request #51 from felixheld/liteeth-untangling

Include the ethernet related header files conditionally

Include the ethernet related header files conditionally

Only including those header files in the litex firmware is the first step to
move the firmware parts of liteeth to the liteeth tree.

Merge pull request #49 from mithro/fix-uart-override

soc_core: Don't fail if name is the same.

soc_core: Don't fail if name is the same.

Otherwise you can't override the UART with another UART, you get an
error like;

```
  File "/home/tansell/github/timvideos/HDMI2USB-litex-firmware/third_party/litex/litex/soc/integration/soc_core.py", line 176, in __init__
    interrupt, mod_name, interrupt_rmap[interrupt]))
AssertionError: Interrupt vector conflict for IRQ 2, user defined uart conflicts with SoC inbuilt uart
```

Merge pull request #48 from mithro/fix-constants

cpu_interface: Fix indenting on constant generation.

cpu_interface: Fix indenting on constant generation.

This was preventing constants from getting added to the csr.h header
file.

Merge pull request #47 from felixheld/indentation-fixes

Fix all remaining indentation issues in python code

Fix all remaining indentation issues in python code

I ran a script that shouldn't have missed any tab in the python source files.

bios/sdram: make read leveling robust for KUS SDRAM

Increases the initial delay step into the valid read window as
with the original delay I was not getting out of the noisy
transition window, as evidenced by seeing read delay windows
of only 8 LSB ~10% of the time, leading to failing memory
tests

Merge pull request #44 from felixheld/nexys_video-dram-fix

Fix DDR3 on nexys_video

Merge pull request #45 from felixheld/arty-ddr3-fix

fix DDR3 on arty

fix DDR3 on arty

fix DDR3 on nexys_video

Merge pull request #43 from felixheld/programmer-error-fix

fix the unsupported programmer case for kc705 and minispartan6

fix the unsupported programmer case for kc705 and minispartan6

Merge pull request #42 from felixheld/requirements-fix

add pyserial to the package requirements

add pyserial to the package requirements

litex_term requires pyserial

build/xilinx/vivado: only generate constraints that are not empty

bios/sdram: revert capability to do manual read leveling since still needed with some targets

bios/sdram: fix data error reporting

bump year

build: add Inverted property to IOs to ease inverting signals and propagate property to cores

soc/integration/soc_core: avoid removing uart interrupts (break some designs)

Merge pull request #40 from mithro/or1k-linux

cpu: Adding "variant" support.

Merge pull request #41 from cr1901/python-3.6

fhdl/tracer: Import Python 3.5/3.6 version guards from Migen.

fhdl/tracer: Import Python 3.5/3.6 version guards from Migen.

cpu: Adding "variant" support.

It is useful to support slightly different variants of the CPU
configurations. This adds a "cpu_variant" option.

For the mor1k we now have the default mor1k configuration and the
"linux" variant which enables the features needed for Linux support on
the mor1k.

Currently there are no variants for the lm32, but we will likely add a
"tiny" variant for usage on the iCE40.

Merge pull request #39 from mithro/master

Wait longer before giving up on the 2nd tftp block.

Wait longer before giving up on the 2nd tftp block.

Previously we would wait the same number of iterations as it took us to
receive the first data block after sending the request. When using the
build in tftp server in qemu, the first wait loop succeeds (and thus
breaks when 'i' is still 0.

Since the counter was never reset between the first and second data
block, under qemu the tftp_get call would fail before ever checking if
we have received the second block of data.

Now that we initialise 'i' to 12M, we ensure that we wait the same
amount of time for the second data block as it previously did for the
third (and subsequent) blocks.

bios/sdram: use same initialization procedure for artix7 than kintex7 excepting write leveling that is not done

soc/integration/builder: don't build bios is user is providing rom data

Merge pull request #38 from cr1901/mercury

Add Mercury baseboard support from Migen, import fixes.

Merge pull request #37 from bunnie/add_tracelength

Add tracelength report generation by default to help with board layout

Add tracelength report generation by default to help with board layout

boards/platforms/tinyfpga_b: add defaut serial pins

build/lattice/icestorm: fix missing toolchain_path

Add TinyFPGA platform based on Migen.

Import Icestorm backend improvements from Migen.

soc/integration/soc_core: add uart_name parameters (allow selecting uart without modifications in platform file)

build/xilinx/programmer: fix settings in run_vivado (update)

Add Mercury baseboard support from Migen, import fixes.

build/xilinx: add support for edif/ngc files

cpu/picorv32: adapt to current version, some cleanup

cpu: cleanup wrappers

soc/integration/soc_core: add integrated_rom_init to allow initializing rom with custom code

targets/sim: fix

soc/integration/soc_core: make nmi interrupt optional

soc/integration: add integrated_main_ram_init parameter to allow using main_ram with pre-initialized firmware

soc/interconnect/stream: fix specific cases for last/first signal in UpConverter

Merge pull request #36 from mattkelly/fix-readme-typo

Fix typo in README: experimental

Fix typo in README: experimental

soc/software/bios/sdram: add Kintex Ultrascale support

README: update copyrights

soc/interconnect/stream: expose depth on SyncFIFO

Merge pull request #34 from mithro/uart-irq-change

Change the default IRQs.

Make the interrupt dicts read only.

Make it harder to have conflicting interrupts.

Bump the IRQ for liteeth based targets.

Change the default IRQs.

 * Reserve IRQ 0 to be used as a "non-maskable interrupt" (NMI) in the
   future.

 * Use IRQ 2 for the LiteX. This matches the standard mor1k config which
   connects the UART to IRQ 2.

This change is needed for Linux running on LiteX as it gets grumpy with
using IRQ 0 for anything other other than an NMI.

build/xilinx: Fixing settings finding.

 * Better error messages.
 * Search correct directories;
   - XXX/Vivado/<version>
   - XXX/<version>/ISE_DS/

Merge pull request #32 from felixheld/fix-readme

remove Migen as requirement for LiteX from the quick start guide

remove Migen as requirement for LiteX from the quick start guide

Migen currently isn't a dependency for LiteX

soc/interconnect/stream: don't use reset less on last and first signals (not reseting these signals can cause troubles in some specific cases)

Merge pull request #31 from mithro/bios-fix

Couple of small fixes.

Output better error message for flash_proxy.

bios: Print location jumping too.

Makes it easier to  understand what is happening (and that the BIOS is
jumping to the right place).

common: Compile with debugging symbols on.

Debugging symbols are useful when using GDB :-)

or1k: Use EXCEPTION_STACK_SIZE of 256bytes.

or1k defines a 128 byte "red zone" after the stack that can not be
touched by the exception handler.

We also need 128 bytes to store the 32 registers.

bios: Declare dependency on linked in .a files.

Merge pull request #30 from cr1901/icestorm

Add Icestorm backend and iCEStick

Add iCEStick board. Tested with litescope.

Port IceStorm backend from Migen.

soc/cores: add cordic

Merge pull request #28 from enjoy-digital/eb-docs-2

More docs for etherbone packet fields.

gen/fhdl/verilog: revert _printcomb_simulation and _printcomb_regular (needed for icarus simulation) and add Finish command

soc/integration/soc_core: add ident_version parameter to allow adding soc version to identifier

More docs for etherbone packet fields.

Info comes from http://www.ohwr.org/attachments/1669/spec.pdf dated 24 July 2012

Merge pull request #27 from enjoy-digital/etherbone-docs

Adding a little docs to field descriptions.