stats: Rename the info classes to hopefully make things a bit clearer
FooInfoBase became FooInfo
FooInfo became FooInfoProxy

stats: update reference outputs now that compatibility is gone
Because of the initialization bug, it wasn't consistent anyway.

stats: remove simplescalar compatibility for printing

stats: fix initialization bug in distribution text output

i8254xGBe: major style overhaul.
Moved DescCache template functions from .hh to .cc file.
Also fixed lots of line-wrapping problems, and some irregular indentation.

Update stats for new single bad-address responder.
Mostly just config.ini updates, though the different response
latency for bad addresses caused very minor timing changes
in the O3 Linux boot tests.

mem: use single BadAddr responder per system.
Previously there was one per bus, which caused some coherence problems
when more than one decided to respond.  Now there is just one on
the main memory bus.  The default bus responder on all other buses
is now the downstream cache's cpu_side port.  Caches no longer need
to do address range filtering; instead, we just have a simple flag
to prevent snoops from propagating to the I/O bus.

scons:  Rename the basic environment from env -> main.
env is used as a local variable all over the place and sometimes it is
easy to get confused as to whether the global env or local env is being
used.  This will become especially important when I change the way we
support our variants.

scons: Fix two problems with the way that the library path is generated.
1) -L is automatically added, so don't do it ourselves
2) prepend the paths for gzstream and libelf so they are certain to
come first. The problem is that python might add /usr/lib to the path
and the user might have a locally installed version of libelf installed.

Automated merge with ssh://m5sim.org//repo/m5

pseudo: only include kernel stats if FULL_SYSTEM.

arm: include missing file for arm

arm: Unify the ARM tlb.  We forgot about this when we did the rest.
This code compiles, but there are no tests still

rundiff: flush stdout after each diff

scons: make default target work again

Set up m5threads tests on classic (non-ruby) memory system.
Just one test (40.m5threads-test-atomic) is set up for now.
These tests require that the m5threads SPARC binaries are present
in /dist or in test-progs.

syscall_emul: style fixes (mostly wrapping overly long lines)

syscall: Resolve conflicts between m5threads and Gabe's recent SE changes.

Commit m5threads package.

This patch adds limited multithreading support in syscall-emulation
mode, by using the clone system call.  The clone system call works
for Alpha, SPARC and x86, and multithreaded applications run
correctly in Alpha and SPARC.

SCons: Export export_vars so SConsopts files can add to them

Minor tweaks for future Ruby compatibility.

request: add PREFETCH flag.

request: rename INST_READ to INST_FETCH.

request: split public and private flags into separate fields.
This frees up needed space for more public flags.  Also:
- remove unused Request accessor methods
- make Packet use public Request accessors, so it need not be a friend

Mem: Fill out the comment that describes the LOCKED request flag.

Mem: Change isLlsc to isLLSC.

X86: Fix the functions that manipulate large bit arrays in the local APIC.

X86: Fix up a copyright.

X86: Fix how the TLB handles the storecheck flag.

X86: Recognize and handle the lock legacy prefix.

X86: Implement a locking version of XADD.

X86: Implement a locking version of BTC.

X86: Implement a locking version of BTR.

X86: Implement a locking version of CMPXCHG.

X86: Implement a locking version of BTS.

X86: Implement a locking version of DEC.

X86: Implement a locking version of INC.

X86: Implement a locking version of NEG.

X86: Implement a locking version of NOT.

X86: Implement a locking version of XCHG.

X86: Implement a locking version of XOR.

X86: Implement a locking version of SUB.

X86: Implement a locking version of AND.

X86: Implement a locking version of SBB.

X86: Implement a locking version of ADC.

X86: Implement a locking version of OR.

X86: Implement a locking version of ADD.

X86: Implement the stul microop.
This microop does a store and unlocks the requested address. The RISC86
microop ISA doesn't seem to have an equivalent to this, so I'm guessing that
the store following an ldstl is automatically unlocking. We don't do it this
way for performance reasons since the behavior is the same.

X86: Implement the ldstl microop.
This microop does a load, checks that a store would succeed, and locks the
requested address.

CPUs: Make the atomic CPU support locked memory accesses.

Memory: Add a LOCKED flag back in for x86 style locking.

Memory: Rename LOCKED for load locked store conditional to LLSC.

SE mode: Make keeping track of the number of syscalls less hacky.

X86: Actually put the PCI INTA entry into the MP tables.

X86: Mask the PIC at startup to avoid a glitch which causes an NMI.

X86: Make E820 report nice, round (and correct) numbers.

X86: Actually handle 16 bit mode modrm.

X86: Make the TEST instruction set all the flags it's supposed to.

X86: Implement broadcast IPIs.

X86: Fix the ordering of the vendor string reported by CPUID.

X86: Keep track of what the initial count value was in the LAPIC timer.

X86: Only recognize the first startup IPI after INIT or reset.

X86: Use recvResponse to implement the idle bit in the Local APIC ICR.

X86: Add a function which gets called when an interrupt message has been delivered.

X86: Fix the flags for interrupt response messages.

X86: Explicitly use the right width in a few places that need a 64 bit value.

X86: Keep track of the pioAddr for the local APIC.

X86: Implement far jmp.

X86: Some segment selectors can be used when "NULL".

X86: Fix a bug in the chks microop where it ignored that it found a fault.

X86: Make the interrupt entering microcode record the value to use, not actually use it.

X86: LEA calculates an address before segmentation.

X86: Implement the save machine status word instruction (SMSW).

X86: Implement the load machine status word instruction (LMSW).

X86: Update the stats for the fix for CPUID.

X86: Only use %eax to select a function and look like we support sse2.

X86: Fix the mov to segment selector in real mode instruction microcode.

X86: The startup IPI delivery mode is not reserved.

X86: Implement the STARTUP IPI.

X86: Implement the INIT IPI.

X86: Fix the halt microop.

X86: Start implementing the interrupt command register in the local APIC.

X86: Make code that sends an interrupt from the IO APIC available for IPIs.

X86: Automatically make the IO APIC in an N CPU system have id N+1.

CPU: If the simple CPU is already idle, just return from suspendContext, don't assert.

X86: Condense the startupCPU code.

X86: Set the local APIC ID to something meaningful.

X86: Don't pretend to be an AMD CPU any more. We're not good enough at it.

o3-mips-regress: add hello word regression.

mips-tlb-fix: check for alignment faults.\nMIPS was never updated to use TLBS correcty in SE mode. The error was forwarding translations directly to pageTable. The TLB should check for alignment faults at bare minimum here but in the long run we should be using TLBs in SE mode for MIPS.

mips-syscall: mark with correct flag. \nMIPS was using wrong serialization flag on syscall instructions allowing O3 to handle SE mode syscalls incorrectly and speculate on instructions after a syscall

o3-delay-slot-bpred: fix decode stage handling of uncdtl. branches.\n decode stage was not setting the predicted PC correctly or passing that information back to fetch correctly

mips-shadowsets: fix calcuations. \n  Remove Shadowsets from Int & Arch. Reg Calculations

o3, inorder: fix FS bug due to initializing ThreadState to Halted.
For some reason o3 FS init() only called initCPU if the thread state
was Suspended, which was no longer the case.  There's no apparent
reason to check, so I whacked the test completely rather than
changing the check to Halted.
The inorder init() was also updated to be symmetric, though the
previous code was just a fancy no-op.

o3: handle fetch with no active threads correctly.
This situation can arise now on the first fetch cycle after
the last active thread is halted.  It seems easy enough to
deal with when it happens rather than trying to avoid it.

o3: fix {read,set}ArchFloatReg* functions.
Register indices were not being calculated properly.

ThreadState: initialize status to Halted in constructor.
This provides a common initial status for all threads independent
of CPU model (unlike the prior situation where CPUs initialized
threads to inconsistent states).
This mostly matters for SE mode; in FS mode, ISA-specific startupCPU()
methods generally handle boot-time initialization of thread contexts
(since the right thing to do is ISA-dependent).

Update stats after elimination of Unallocated state.
Somehow ending threads with halt() instead of deallocate()
reduces the squash count on o3 by 1 (and a few other
similarly trivial changes).

Get rid of the Unallocated thread context state.
Basically merge it in with Halted.
Also had to get rid of a few other functions that
called ThreadContext::deallocate(), including:
 - InOrderCPU's setThreadRescheduleCondition.
 - ThreadContext::exit().  This function was there to avoid terminating
   simulation when one thread out of a multi-thread workload exits, but we
   need to find a better (non-cpu-centric) way.

configs: Allow M5_CPU2000 env var to set CPU2K binary path.
It would be nice to have a more comprehensive mechanism
but this is a big improvement over manually editing the script.