Minor usability improvements (#48)

* spike_main/disasm.cc: Print unknown CSR numbers in hex

* interactive mode: Print "Unknown command" when appropriate

DCSR cause was moved, bug debug ROM wasn't updated

As a result Debug ROM would always take the spontaneous halt code path.
This didn't hurt spike since (so far?) the spike debug handler doesn't
attempt to do anything quick while code is running. But now the ROM is
more correct.

Fix 'make check' when run from build directory.

Fix build when not building inside root directory

Add gitignore

Move sethaltnot and cleardebint.

Now it matches Krste's memory map.

New encoding.h for new CSR addresses.

Move cleardebint, per spec.

Use .word for mret, for now.

The current assembler doesn't seem to know it?

Change DCSR bits to match spec.

Cleaned up debug ROM code a little.

Kill spike as soon as the test is done with it.

Link standalone programs at 0x80010000.

This leaves some memory for pk, where it keeps tohost/fromhost which we
cannot just write to.

Turn off debugging.

All the printfs would be pretty annoying if you're actually using this
to debug something.

Also fixed a small jump bug in halt.

Tell gdb we can handle large packets.

This speeds up downloads to 93KB/s, which is starting to get usable.

Fix writing odd numbers of bytes to odd addresses.

Exceptions in Debug Mode don't update any regs.

Ignore MPRV in Debug Mode.

Write test for downloading a mostly random program

It passes, but it's slow.

Remove already-implemented TODO.

Move debug rom link map to the right place.

Turns out this doesn't actually matter, but it's better to be correct.

Remove obsolete TODO.

Implement ebreak[mhsu].

Remove dependency on include file in my homedir.

Force gdb to not print entry values.

All of a sudden gdb decided to start printing them, which messed up the
breakpoint test. It would only print them in the test, not if I manually
ran the same commands. I'm sure it's my fault somehow, but this should
keep things consistent in the future.

mprv test now breaks like it's supposed to.

Deal with escapes that gdb sends in binary data.

Make -H halt the core right out of reset.

Added a test, too.

Halt when gdb user hits ^C.

Make sure to fence.i after setting/clearing a swbp

This doesn't change anything since Debug ROM already executes a fence.i,
but it will be more correct if that is no longer necessary.

Implemented register writes.

All existing tests pass!

Fix reading CSRs.

Single step appears to work.

Software breakpoints sort of work.

Use fence.i in Debug ROM.

This replaces a hack that just disabled all of the icache.

Fix off-by-two in general read registers.

Now the exit test passes!

Walk page tables to translate addresses.

Turn operation into a queue,

in preparation for address translation.

Remove unused code.

Add some debug printfs, which I'll be wanting for at least a little
while.

Save/restore mstatus, too.

Also read DCSR, which will be useful to figure out why we halted.

Ignore more files.

Properly read s0/s1.

Add dret.

Implement memory writes.

Implement single memory read access.

Prevent unaligned accesses in memory read.

Also change how exceptions in Debug Mode are signaled.

Properly save/restore dpc, mcause, mbadaddr.

Also clear dcsr.cause when leaving Debug Mode so future traps go where
they should.

Exceptions in Debug Mode, stay in Debug Mode.

Now things don't blow up when reading a non-existent CSR.

Remove debug printfs.

Have Debug memory kind of working again.

Debug exception -> ROM -> RAM -> ROM, then something goes wrong.

Read FP registers, and general CSRs*

*) Only works if you read CSRs that actually exist.

Continue works well enough for DebugTest.test_exit

Fix race using fence.

Refactor how we track in-progress operations.

I think the functionality is unchanged.

gdb can attach and read the PC:

(gdb) target remote localhost:1234
Remote debugging using localhost:1234
0x0000000000010178 in fib (n=0) at waste.c:1
1       unsigned int fib(unsigned int n) {
(gdb)

processor_t unfriends gdbserver_t.

Correctly read PC on halt.

Fix store to clear debug interrupt.

Add debug_module bus device.

This should replace the ROM hack I implemented earlier, but for now both
exist together.

Back to the point where gdb connects, core jumps to ROM->RAM->ROM.

ROM -> RAM -> ROM, waiting for debug int.

Make sure to translate Debug RAM addresses also.

Jump to the correct (temporary) Debug RAM address.

Clean up how Debug ROM is included.

I'm not thrilled about including a static copy in so many cc files, and
making the compiler throw it out. But without really grokking the
Makefile this is the best it's going to be.

Can jump to and execute Debug ROM.

Connect with gdb, and the core will jump to Debug ROM and start
executing it. Then it crashes when it jumps to 0x400 because Debug RAM
isn't implemented (and doesn't live there anyway, for now).

Check in compiled debug ROM.

Not everybody will have a cross-compiled toolchain set up when they
build spike.

When gdb connects, jump to Debug ROM and segfault.

Add debug rom code.

Gutting direct-access gdb.

Add writing to DCSR, DPC, DSCRATCH.

Make those 3 CSRs writable.

Actually run the ebreak test.

Only halt on ebreak if a debugger is attached.

Test ebreak without gdb.

Currently this test fails.

Document attaching with gdb.

Add --gdb-port

It's necessary to be able to run multiple spikes at once on the same
box.

Do a better job checking CSR functionality.

Rename gdbserver-smoke.py to gdbserver.py.

It's not really a smoketest anymore.

Test 'info registers all' as well as 'info all-registers'

Minor cleanup.

Update regnum handling to match gdb CSR changes.

Forgot to add this source.

Treat warnings as errors.

The code compiles cleanly right now. Let's keep it that way.

Implement register writes.

Properly clean up spike.

Implement reading of CSRs.

Add some tests that pass and test something.

Flush icache when using swbps and report to gdb.

Add very basic 'make check'.

The existing stuff all assumes you're writing your tests in C++.

Make 'make check' not hang forever.

Software breakpoints seem to work.

Rewrite GPL'd code from OpenOCD.

Looks like single step works.

Add -H to start halted.

Implement binary memory write.

Also set the simulation running again when gdb disconnects.

Now you can halt/continue from gdb.

Register read looks sane now.

gdb can now read spike memory.

The endianness is wrong, but I think it might be that gdb doesn't have
it right. Need to investigate what architecture gdb thinks it's
debugging.

Hack to the point where gdb reads a register.

Listen on a socket for gdb to connect to.

So far it just listens, and gdb times out because it's not getting any
messages back.

Receive packets and verify their checksum.

Allow delegation of device interrupts

htif: catch proper store exception (#44)

The sim's debug_mmu will generate a trap_load_access_fault if the load
fails, not a trap_store_access_fault.  This doesn't materially affect
exection, but results in a nicer log message.

Some bugfixes for CSR reading and setting FS for fflags updates (#43)

* csrrc[i] and csrrs[i] don't write CSRs if rs/zimm == 0

* Dirty fp state when setting new fp exceptions

* Set FS to dirty for all non-zero fflags writes.

Merge pull request #42 from csail-csg/master

Removed devicetree.h from riscv.mk.in since it no longer exists