vl: initial va-api implementation

vl: more work on the bitstream_parser

vl: bitstream decoder finds startcodes

vl: some more fixes and addition to the decoder handling

vl: implemented a few functions and made stubs to get mplayer running

vl: initial commit of the bitstream parser

Merge branch 'pipe-video' of ssh://cgit.freedesktop.org/~tball/mesa-gallium-vdpau into pipe-video

Merge branch 'master' of ssh://cgit.freedesktop.org/~tball/mesa-gallium-vdpau into pipe-video

Merge remote branch 'origin/master' into pipe-video

r600g: simplify block relocation

Since flush rework there could be only one relocation per
register in a block.

Signed-off-by: Jerome Glisse <jglisse@redhat.com>

r600g: use dirty list to track dirty blocks

Got a speed up by tracking the dirty blocks in a seperate list instead of looping through all blocks. This version should work with block that get their dirty state disabled again and I added a dirty check during the flush as some blocks were already dirty.

docs: added news item for 7.9 release

Also fix link to release notes in 7.9-rc1 news item.

docs: Import news updates from 7.9 branch

Partially cherry-picked from commit 61653b488da76ee1ca4f77363e222d3b717dd865

docs: Update mailing lines from sf.net to freedesktop.org
(cherry picked from commit c19bc5de961fe5e1f8a17131bcfae3dbcccaca29)

docs: download.html does not need to be updated for each release
(cherry picked from commit 41e371e351cc4c77b2b20a545af2dfa2dab253d7)

docs: Import 7.8.x release notes from 7.8 branch.

docs: Import 7.9 release notes from 7.9 branch.

nv50: fix always true conditional in shader optimization

r600g: improve bo flushing

Flush read cache before writting register. Track flushing inside
of a same cs and avoid reflushing same bo if not necessary. Allmost
properly force flush if bo rendered too and then use as a texture
in same cs (missing pipeline flush dunno if it's needed or not).

Signed-off-by: Jerome Glisse <jglisse@redhat.com>

r600g: store reloc information in bo structure

Allow fast lookup of relocation information & id which
was a CPU time consumming operation.

Signed-off-by: Jerome Glisse <jglisse@redhat.com>

vl: change the xvmc state_tracker to the new gallium API

vl: changed video pipe to use the new gallium API within master

Merge branch 'master' into pipe-video

Conflicts:
configs/linux-dri
configure.ac
src/gallium/drivers/nvfx/Makefile
src/gallium/include/pipe/p_defines.h
src/gallium/include/pipe/p_screen.h
src/gallium/include/state_tracker/dri1_api.h
src/gallium/include/state_tracker/drm_api.h
src/gallium/tests/python/samples/tri.py
src/gallium/tests/trivial/Makefile
src/gallium/tests/unit/Makefile
src/gallium/tests/unit/SConscript
src/gallium/tests/unit/u_format_test.c
src/gallium/winsys/nouveau/drm/nouveau_drm_api.c

pb: fix numDelayed accounting

we weren't decreasing when removing from the list.

vl: ...

r600g: avoid unneeded bo wait

if we know the bo has gone not busy, no need to add another bo wait

thanks to Andre (taiu) on irc for pointing this out.

r600g: drop use_mem_constant.

since we plan on using dx10 constant buffers everywhere.

r600g: drop mman allocator

we don't use this since constant buffers are now being used on all gpus.

r600g: add bo busy backoff.

When we go to do a lot of bos in one draw like constant bufs we need
to avoid bouncing off the busy ioctl, this mitigates by backing off
on busy bos for a short amount of times.

pb: don't keep checking buffers after first busy

If we assume busy buffers are added to the list in order its unlikely
we'd fine one after the first busy one that isn't busy.

r600g: add bo fenced list.

this just keeps a list of bos submitted together, and uses them to decide
bo busy state for the whole group.

swrast: fix choose_depth_texture_level() to respect mipmap filtering state

NOTE: this is a candidate for the 7.9 branch.

r300g: fix microtiling for 16-bits-per-channel formats

These texture formats (like R16G16B16A16_UNORM) were untested until now
because st/mesa doesn't use them. I am testing this with a hacked st/mesa
here.

update release notes for Gallium

I am trying to be exhaustive, but still I might have missed tons of other
changes to Gallium.
(cherry picked from commit 968a9ec76eadf55e8b58171884e1175d7b8cf59a)

Conflicts:

docs/relnotes-7.9.html

docs: Add list of bugs fixed in 7.9

i965: Add support for gen6 FB writes to the new FS.

This uses message headers for now, since we'll need it for MRT.  We
can cut out the header later.

i965: In disasm, gen6 fb writes don't put msg reg # in destreg_conditionalmod.

It instead sensibly appears in the src0 slot.

i965: Add initial folding of constants into operand immediate slots.

We could try to detect this in expression handling and do it
proactively there, but it seems like less logic to do it in one
optional pass at the end.

i965: Add trivial dead code elimination in the new FS backend.

The glsl core should be handling most dead code issues for us, but we
generate some things in codegen that may not get used, like the 1/w
value or pixel deltas.  It seems a lot easier this way than trying to
work out up front whether we're going to use those values or not.

i965: Be more conservative on live interval calculation.

This also means that our intervals now highlight dead code.

r600g: Fix SCons build.

r600g: remove dead label & fix indentation

Signed-off-by: Jerome Glisse <jglisse@redhat.com>

r600g: rename radeon_ws_bo to r600_bo

Signed-off-by: Jerome Glisse <jglisse@redhat.com>

r600g: use r600_bo for relocation argument, simplify code

Signed-off-by: Jerome Glisse <jglisse@redhat.com>

r600g: allow r600_bo to be a sub allocation of a big bo

Add bo offset everywhere needed if r600_bo is ever a sub bo
of a bigger bo.

Signed-off-by: Jerome Glisse <jglisse@redhat.com>

r600g: rename radeon_ws_bo to r600_bo

Signed-off-by: Jerome Glisse <jglisse@redhat.com>

nvfx: Pair os_malloc_aligned() with os_free_aligned().

From AROS.

r600g: TODO domain management

no wonder it was slow, the code is deliberately forcing stuff into GTT,
we used to have domain management but it seems to have disappeared.

r600g: fix wwarning in bo_map function

r600g: the code to check whether a new vertex shader is needed was wrong

this code was memcmp'ing two structs, but refcounting one of them afterwards,
so any subsequent memcmp was never going to work.

again this stops unnecessary uploads of vertex program,

r600g: break out of search for reloc bo after finding it.

this function was taking quite a lot of pointless CPU.

i965: Fix glean/texSwizzle regression in previous commit.

Easy enough patch, who needs a full test run.  Oh, that's right.  Me.

i965: Set up swizzling of shadow compare results for GL_DEPTH_TEXTURE_MODE.

The brw_wm_surface_state.c handling of GL_DEPTH_TEXTURE_MODE doesn't
apply to shadow compares, which always return an intensity value.  The
texture swizzles can do the job for us.

Fixes:
glsl1-shadow2D(): 1
glsl1-shadow2D(): 3

i965: Add support for EXT_texture_swizzle to the new FS backend.

r300g: add support for L8A8 colorbuffers

Blending with DST_ALPHA is undefined. SRC_ALPHA works, though.
I bet some other formats have similar limitations too.

r300g: add support for R8G8 colorbuffers

The hw swizzles have been obtained by a brute force approach,
and only C0 and C2 are stored in UV88, the other channels are
ignored.

R16G16 is going to be a lot trickier.

mesa/st: initial attempt at RG support for gallium drivers

passes all piglit RG tests with softpipe.

i965: Fix incorrect batchbuffer size in gen6 clip state command.

FORCE_ZERO_RTAINDEX should be in the fourth (and final) dword.

i965: Don't try to emit code if we failed register allocation.

i965: Fix off-by-ones in handling the last members of register classes.

Luckily, one of them would result in failing out register allocation
when the other bugs were encountered.  Applies to
glsl-fs-vec4-indexing-temp-dst-in-nested-loop-combined, which still
fails register allocation, but now legitimately.

i965: Add a sanity check for register allocation sizes.

i965: When producing a single channel swizzle, don't make a temporary.

This quickly cuts 8% of the instructions in my glsl demo.

i965: Restore the forcing of aligned pairs for delta_xy on chips with PLN.

By doing so using the register allocator now, we avoid wasting a
register to make the alignment happen.

r600c: fix segfault in evergreen stencil code

Fixes:
https://bugs.freedesktop.org/show_bug.cgi?id=30551

r600g: Remove unnecessary headers.

r600g: Remove unused variable.

Fixes this GCC warning.
r600_shader.c: In function 'tgsi_split_literal_constant':
r600_shader.c:818: warning: unused variable 'index'

rgtc: Detect RGTC formats as color formats and as compressed formats

mesa: Trivial correction to comment

mesa: Fix misplaced #endif

If FEATURE_texture_s3tc is not defined, FXT1 formats would erroneously
fall through to the MESA_FORMAT_RGBA_FLOAT32 case.

ARB_texture_rg: Add GL_COMPRESSED_{RED,RG} cases in _mesa_is_color_format

mesa: Add ARB_texture_compression_rgtc as an alias for EXT_texture_compression_rgtc

Change the name in the extension tracking structure to ARB (from EXT).

savage: Remove unnecessary header.

glsl: Remove unnecessary header.

i965: Enable GL_ARB_texture_rg

mesa: Enable GL_ARB_texture_rg in software paths

ARB_texture_rg: Allow RED and RG textures as FBO color buffer attachments

ARB_texture_rg: Add R8, R16, RG88, and RG1616 internal formats

ARB_texture_rg: Handle RED and RG the same as RGB for tex env

ARB_texture_rg: Add GL_RED as a valid GL_DEPTH_TEXTURE_MODE

ARB_texture_rg: Add GL_TEXTURE_{RED,GREEN}_SIZE query support

ARB_texture_rg: Correct some errors in RED / RG internal format handling

Fixes several problems:

The half-float, float, and integer internal formats depend on
ARB_texture_rg and other extensions.

RG_INTEGER is not a valid internal format.

Generic compressed formats depend on ARB_texture_rg, not
EXT_texture_compression_rgtc.

Use GL_RED instead of GL_R.

ARB_texture_rg: Add GLX protocol support

i965g: use Elements macro instead of manual sizeofs

Signed-off-by: Nicolas Kaiser <nikai@nikai.net>
Signed-off-by: Brian Paul <brianp@vmware.com>

i965: Fix up copy'n'pasteo from moving coordinate setup around for gen4.

i965: Add real support for pre-gen5 texture sampling to the new FS.

Fixes 36 testcases, including glsl-fs-shadow2d*-bias which fail on the
Mesa IR backend.

evergreen : fix z format setting, enable stencil.

i965: Pre-gen6, map VS outputs (not FS inputs) to URB setup in the new FS.

We should fix the SF to actually give us just the data we need, but
this fixes regressions in the new FS until then.

Fixes:
glsl-kwin-blur
glsl-routing

i965: Also increment attribute location when skipping unused slots.

Fixes glsl1-texcoord varying.

i965: Fix the gen6 jump size for BREAK/CONT in new FS.

Since gen5, jumps are in increments of 64 bits instead of increments
of 128-bit instructions.

i965: Add gen6 attribute interpolation to new FS backend.

Untested, since my hardware is not booting at the moment.

r600g: indentation fixes

Signed-off-by: Jerome Glisse <jglisse@redhat.com>

r600g: setup basic loop consts on r600 + evergreen.

this sets up a single loop constant like r600c does.

r600g: only set the Z export if shader exports it.

r600c: pull over 6xx/7xx vertex fixes for evergreen

r600g: flush SH cache on constant change on evergreen

r600g: fix evergreen draw-buffers

just a typo in the register headers.

r600g: add cb flushing for extra buffers + depth buffer on r600/evergreen

r600g: sync vertex/texture cache on resources on evergreen

this gets rid of lots of the instability on evergreen,
which isn't surprising since it really broken not to flush caches.

r600g: fixup vertex format picking.

there are some vertex formats defined in r600c not in the docs.

r600g: add assembler support for other vtx fetch fields.

this shouldn't change behaviour, just push the choice of what
to do out to the shader.