Merge pull request #2078 from YosysHQ/eddie/xilinx_sim_tidy
[yosys.git] / tests / verilog /
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-rw-r--r-- 757 bug2042-sv.ys
-rw-r--r-- 164 bug2042.ys
-rwxr-xr-x 376 run-test.sh
-rw-r--r-- 460 task_attr.ys
-rw-r--r-- 65 upto.ys