fix unittest test_compldst_multi_mmu.py (load now returned byte previously stored)

test_compldst_multi_mmu.py: use nmigen.back.pysim

test_compldst_multi_mmu.py: use nmigen.compat.sim

replace PartitionedSignal with SimdSignal

nix: Remove outdated comment about license

Merge branch 'pr' from nix-soc

comments for test_runner

added comment to teststate

cleanup test_compldst_multi_mmu.py

refactoring test_compldst_multi_mmu.py

update test_compldst_multi_mmu.py to use pagetables

move pagetable to external file

add wishbone driver for test_compldst_multi_mmu.py

update test_compldst_multi_mmu.py

src/soc/experiment/compldst_multi.py: update signal names in load()

use LoadStore1 and DCache in test_compldst_multi_mmu.py

more cleanup on pimem.py

whitespace

remove redunant pi_dcbz

an extra dcbz parameter in all six places

have to remove dcbz from pimem.py entirely

commented-out and disabled the set_dcbz_addr function, it is the wrong
approach.

it is much better to add an extra parameter to set_wr_addr
"dcbz".

this to be added right across all set_wr_addr functions
(6 places)

dcbz: cleanup

dcbz symbol rename

loadstore.py: add function set_dcbz_addr

update test_dcbz_pi.py test case

PortInterfaceBase: add dcbz handling

move TestRunner to openpower-isa now that it is part of the Test API
 https://bugs.libre-soc.org/show_bug.cgi?id=686
commit 5d5a1807d553985c25bdc8bf4d04aedfecddf34f openpower-isa repo

compldst_multi.py: pass dcbz to portinterface

testcase for compldst: wait for address

rename ra_needed to zero_a

update testcase for dcbz

add testcase for dcbz

add a state list for method calling

found accidental commenting-out of memory setup in HDLRunner

move debug printout to see whats going on for ldst

comments

Revert "move coresync clock synchronisation into HDLRunner"

This reverts commit 8a51f6944fa6c5185285b0139f5b419fb68aa145.

call StateRunner constructor, to add to StateRunner class Factory

more TODO comments

move coresync clock synchronisation into HDLRunner

whoops missed one function which should be a yield (of nothing)

use yield from on StateRunners

add comments, remove unneeded code
https://bugs.libre-soc.org/show_bug.cgi?id=686#c73

move pc_i and svstate_i to HDLRunner

add end_test, minor cleanup, added hdlrun.cleanup() call

moved pc_i and sv_state to constructor, remove hdl_state_run

change over run_hdl_state to TestRunner class

add dummy call to simrun and end_test()

code-comments and dummy functions

move contents of run_sim_state into SimRunner run_test function

add a SimRunner prepare_for_test and run_test function

comments for test_runner

added comment to teststate

flake.nix: Clean up

cleanup test_compldst_multi_mmu.py

ecp5-program: Delete garbage

Update lock file

refactoring test_compldst_multi_mmu.py

update test_compldst_multi_mmu.py to use pagetables

move pagetable to external file

add wishbone driver for test_compldst_multi_mmu.py

update test_compldst_multi_mmu.py

src/soc/experiment/compldst_multi.py: update signal names in load()

use LoadStore1 and DCache in test_compldst_multi_mmu.py

more cleanup on pimem.py

whitespace

remove redunant pi_dcbz

an extra dcbz parameter in all six places

have to remove dcbz from pimem.py entirely

commented-out and disabled the set_dcbz_addr function, it is the wrong
approach.

it is much better to add an extra parameter to set_wr_addr
"dcbz".

this to be added right across all set_wr_addr functions
(6 places)

dcbz: cleanup

dcbz symbol rename

loadstore.py: add function set_dcbz_addr

update test_dcbz_pi.py test case

PortInterfaceBase: add dcbz handling

move TestRunner to openpower-isa now that it is part of the Test API
 https://bugs.libre-soc.org/show_bug.cgi?id=686
commit 5d5a1807d553985c25bdc8bf4d04aedfecddf34f openpower-isa repo

compldst_multi.py: pass dcbz to portinterface

testcase for compldst: wait for address

rename ra_needed to zero_a

update testcase for dcbz

add testcase for dcbz

Add script for loading Libre-SOC onto Versa ECP5 board!

add a state list for method calling

found accidental commenting-out of memory setup in HDLRunner

move debug printout to see whats going on for ldst

comments

Revert "move coresync clock synchronisation into HDLRunner"

This reverts commit 8a51f6944fa6c5185285b0139f5b419fb68aa145.

call StateRunner constructor, to add to StateRunner class Factory

more TODO comments

move coresync clock synchronisation into HDLRunner

whoops missed one function which should be a yield (of nothing)

use yield from on StateRunners

Merge remote-tracking branch 'upstream/master' into pr

Update libresoc-litex submodule

Update libresoc-litex submodule

add comments, remove unneeded code
https://bugs.libre-soc.org/show_bug.cgi?id=686#c73

Fix building for a Versa ECP5

move pc_i and svstate_i to HDLRunner

add end_test, minor cleanup, added hdlrun.cleanup() call