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authorAlex Solomatnikov <sols@gamma06.internal.sifive.com>
Tue, 7 Feb 2017 23:58:04 +0000 (15:58 -0800)
committerAlex Solomatnikov <sols@gamma06.internal.sifive.com>
Tue, 7 Feb 2017 23:58:04 +0000 (15:58 -0800)
src/main/scala/devices/i2c/I2C.scala

index 0fcf64080e28ad44dfeeb3b20488731783060096..543b5917c8063fd947dd8bd0de2912133cac9e8c 100644 (file)
@@ -1,4 +1,43 @@
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+////                                                             ////
+////  WISHBONE revB.2 compliant I2C Master controller Top-level  ////
+////                                                             ////
+////                                                             ////
+////  Author: Richard Herveille                                  ////
+////          richard@asics.ws                                   ////
+////          www.asics.ws                                       ////
+////                                                             ////
+////  Downloaded from: http://www.opencores.org/projects/i2c/    ////
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+////                                                             ////
+//// Copyright (C) 2001 Richard Herveille                        ////
+////                    richard@asics.ws                         ////
+////                                                             ////
+//// This source file may be used and distributed without        ////
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+// This code was re-written in Chisel by SiFive, Inc.
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