add 2 stage buffered pipeline unit test, reduce to 16-bit to make vcd clearer

only process data if the input strobe is valid

add in some assertions to check pipe output

split out unit test in buf pipe example

combine blocks to add list of statements, add comments

update comments

store inv-strobe in temp signal

clean up code

store processed input in intermediary

add (but comment out) reset signal

add example buffered pipe

add example buffered pipe

get InputGroup running

add inputgroup test

Trigger needs to be combinatorial (saves clock cycles)

return mid as part of ports

whoops, forgot to make input an Array, can use array indexing now

create an FPOps output class to clean up the InputGroup

add capability to pass through operands and muxid to output

make a start on an InputGroup module

add a multi-input stb/ack module

to be used for acknowledging and passing on multiple inputs once all ready

add result array module

create array of in/outs however set muxid to zero temporarily

store fpadd result in putz, next phase: direct to array of output results

allow code-creation

create array of in_a, in_b and out_z

move ids to member variable

chain add stage 0 and 1 together with align in combinatorial block

create combined combinatorial align and add0

merge specialcases and denorm into single combinatorial chain

create specialcasesmod setup fn

whoops forgot self.width

add comments

move localiseable variables to local function

connect corrections to pack with combinatorial logic

connect round directly to corrections with combinatorial logic

connect normalisation directly to round with combinatorial logic

big reorganisation

splitting out Normalisation Single/Multi
adding beginnings of combinatorial-chained normalisation thru pack

split out into 2 functions, longer and compact fragment

move in_t_ack into FPGet2Op setup

add "compact" option

main on FPADD not on FPADDBase

big reorg, got FPADD to work using new FPADDBase

add some comments to FPAddBase

in the middle of rewiring FPADD to use FPADDBase

split out main stages of add to separate class, FPADDBase

add function unit module

correct syntax error

add reservation station row module

add MID testing

add id to pack and putz

add id to FPPack

add id to FPCorrections

add id to FPRound

add id to norm1

add id to stage1

add id to stage0

add id to align

add id to denorm

add id passthrough to specialcases class

reorg special cases setup

add id_width to parameters

remove unneeded code

reorg setup functions in more add phases

cleanup modules, however multi-cycle align needs to be like norm1

split out single-cycle normalisation to separate module

enable single-cycle in FP16 test

single-shift normalisation right-shift: normalisation now a single-cycle phase

use MultiShiftRMerge module instead of shift_down_multi function

remove chain dependence, calculate ediffs in parallel with comparisons

comment out unneeded code for now

convert to only use one multi-shifter

rename stickybit variable

unit test for multi-bit shift right with merge (sticky bit)

cleanup

small optimisation, move subtraction of -126 from exponent into FPNumBase module, use it there and in normalisation

add 3 extra unit tests

limit count leading zeros to stop exponent shift-amount going below min exp

fix shift class syntax errors (untested)

use priority encoder for normalisation in single cycle (done decrease)

add in FPNumShiftMultiRight class

use bool() function instead of reduce(or_)

got single-cycle align working again (accidental combinatorial loop)

turn FPOp into module

move put_z to PutZ class

reorg pack setup

reorg corrections setup

remove unneeded function call

remove global z as output from specialcases, use sc.out_z

remove unneeded variable, use module overflow to get rounding signal

managed to make round signal an output from normalisation phase

tidyup, remove unneeded intermediate

tidyup, remove unneeded intermediate

reorg FPRound move setup function

add comment about add0+add1 stages

add1 module setup reorg

remove temporary external z, use add0 output, connect as add1 input

reorg: move add0 setup function

use correct local output from pack chain

reorganise normalisation init: move setup function from mod to class